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1. (WO2007016607) ALL DIGITAL IMPLEMENTATION OF CLOCK SPECTRUM SPREADING
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2007/016607    International Application No.:    PCT/US2006/030027
Publication Date: 08.02.2007 International Filing Date: 01.08.2006
IPC:
H04B 1/69 (2006.01), H04B 1/707 (2006.01), H04B 1/713 (2006.01), H04L 7/00 (2006.01), H04L 25/00 (2006.01), H03D 3/24 (2006.01)
Applicants: MARVELL WORLD TRADE LTD. [BB/BB]; L'Horizon Gunsite Road, Brittons Hill, St. Michael, BB 14027 (BB) (For All Designated States Except US).
GREENBERG, Jody [US/US]; (US) (For US Only)
Inventors: GREENBERG, Jody; (US)
Agent: BRINKS HOFER GILSON & LIONE, PC; NBC Tower, Suite 3600, 455 North Cityfront Plaza Drive, Chicago, IL 60611-5599 (US)
Priority Data:
60/704,510 01.08.2005 US
60/722,731 30.09.2005 US
11/246,328 06.10.2005 US
Title (EN) ALL DIGITAL IMPLEMENTATION OF CLOCK SPECTRUM SPREADING
(FR) MISE EN OEUVRE TOUT-NUMERIQUE D'ETALEMENT DE SPECTRE D'HORLOGE (SUPERPOSITION) POUR UNE SURFACE DE PUCE A FAIBLE CONSOMMATION D'ENERGIE
Abstract: front page image
(EN)A digital circuit (200) configured to spread a clock train spectrum includes a clock (205) configured to generate the clock train (100), and a variable divider (210) configured to divide the frequency of the clock train by a temporally-varying-divider value to modulate the clock train and generate a dithered clock train (245). The circuit (200) further includes a first accumulator (215) configured to accumulate the dithered clock train (245) to generate a frequency modulation waveform, and a second accumulator (220) configured accumulate the frequency modulated waveform to generate a phase modulation signal (255). The circuit further includes a phase-value calculator configured to calculate the temporally-varying divider value based on the phase modulation signal; and a closed-loop control circuit configured to track and filter the modulation of the dithered clock train to generate a second clock train, that is the spread spectrum of the first mentioned clock train.
(FR)L'invention concerne un circuit numérique conçu pour étaler un spectre de train d'horloge qui comprend une horloge conçue pour générer le train d'horloge, et un diviseur variable conçu pour diviser la fréquence du train d'horloge par une valeur de division variant dans le temps afin que soit modulé le train d'horloge et que soit généré un train d'horloge superposé. Le circuit comprend également un premier accumulateur conçu pour accumuler le train d'horloge superposé afin que soit générée une forme d'onde modulée en fréquence, et un deuxième accumulateur conçu pour accumuler la forme d'onde modulée en fréquence afin que soit généré un signal modulé en phase. Le circuit comprend en outre un calculateur de valeur de phase conçu pour calculer la valeur de division variable dans le temps en fonction du signal modulé en phase ; et un circuit de commande en boucle fermée conçu pour suivre et filtrer la modulation du train d'horloge superposé afin que soit généré un deuxième train d'horloge qui représente le spectre étalé du premier train d'horloge mentionné.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)