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1. (WO2007005392) ANALOG TO DIGITAL CONVERTER WITH PING-PONG ARCHITECTURE
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2007/005392    International Application No.:    PCT/US2006/024888
Publication Date: 11.01.2007 International Filing Date: 27.06.2006
Chapter 2 Demand Filed:    01.02.2007    
IPC:
H03D 3/00 (2006.01), H03M 1/12 (2006.01)
Applicants: DSP GROUP INC. [US/US]; 3120 Scott Blvd., Santa Clara, CA 95054 (US) (For All Designated States Except US).
MAZHAR, Salman [PK/US]; (US) (For US Only)
Inventors: MAZHAR, Salman; (US)
Agent: SHUMAKER, Steven, J.; Shumaker & Sieffert, P.A., 1625 Radio Drive, Suite 300, Woodbury, MN 55125 (US)
Priority Data:
60/695,968 01.07.2005 US
11/390,991 28.03.2006 US
Title (EN) ANALOG TO DIGITAL CONVERTER WITH PING-PONG ARCHITECTURE
(FR) CONVERTISSEUR ANALOGIQUE-NUMERIQUE AVEC ARCHITECTURE PING-PONG
Abstract: front page image
(EN)The invention provides a receiver for use in a wireless communication system that substantially reduces mismatch between an in-phase (I) component and a quadrature (Q) component of a received signal. The receiver achieves this by sharing or 'ping-ponging' an analog-to-digital converter (ADC) between the I and Q components. By sharing a single pipelined ADC between the I and Q components, both the I and Q components are processed by the same circuitry inside the pipelined ADC thereby eliminating many dominant sources of I-Q mismatch. The pipelined ADC operates at approximately twice the speed as other circuit components. Consequently, I-Q mismatch, which negatively affects performance, may be substantially reduced. At the same time, system complexity, cost, and power dissipation are reduced by eliminating an additional ADC typically used to process the I and Q components in parallel signal paths.
(FR)L'invention concerne un récepteur destiné à être utilisé dans un système de communication sans fil permettant de réduire considérablement le désaccord entre une composante en phase (I) et une composante en quadrature (Q) d'un signal reçu. Ce résultat est obtenu par partage ou utilisation 'ping-pong' d'un convertisseur analogique-numérique (ADC) entre les composantes I et Q. En partageant un unique ADC pipe-line entre les composantes I et Q, à la fois la composante I et la composante Q sont traitées par le même ensemble de circuits dans l'ADC pipe-line, ce qui permet d'éliminer de nombreuses sources dominantes de désaccord I-Q. L'ADC pipe-line fonctionne à une vitesse approximativement deux fois supérieure à celle d'autres composantes de circuit. En conséquence, le désaccord I-Q, lequel affecte négativement la performance, peut être significativement diminué. Simultanément, la complexité, le coût et la perte de puissance du système sont diminués par élimination d'un ADC supplémentaire utilisé typiquement pour traiter les composantes I et Q dans des trajets de signaux parallèles.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)