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Pub. No.:    WO/2007/002445    International Application No.:    PCT/US2006/024546
Publication Date: 04.01.2007 International Filing Date: 23.06.2006
G06F 13/16 (2006.01)
Applicants: INTEL CORPORATION [US/US]; 2200 Mission College Boulevard, Santa Clara, California 95052 (US) (For All Designated States Except US).
AKIYAMA, James [US/US]; (US) (For US Only).
CLIFFORD, William [US/US]; (US) (For US Only)
Inventors: AKIYAMA, James; (US).
CLIFFORD, William; (US)
Agent: VINCENT, Lester, J.; BLAKELY SOKOLOFF TAYLOR & ZAFMAN, 12400 Wilshire Boulevard 7th Floor, Los Angeles, California 90025 (US)
Priority Data:
11/165,390 23.06.2005 US
Abstract: front page image
(EN)According to one embodiment, a memory controller is disclosed. The memory controller includes assignment logic and a transaction assembler. The assignment logic receives a request to access a memory channel and assigns the request to access one of two or more independently addressable subchannels within the channel. The transaction assembler combines the request with one or more additional requests to access the two or more independently addressable subchannels within the channel and facilitates a speculative return of data from a subchannel for which a subchannel request is not available.
(FR)Selon un mode de réalisation, la présente invention a trait à un contrôleur de mémoire. Le contrôleur de mémoire comporte une logique d'affectation et un assembleur de transactions. La logique d'affectation reçoit une requête d'accès à un canal de mémoire et la requête d'accès est affecté à un ou deux canaux secondaires adressables indépendamment au sein du canal. L'assembleur de transactions effectue la combinaison de la requête avec une ou deux requêtes supplémentaires d'accès aux deux canaux secondaires au sein du canal et facilite un renvoi spéculatif de données depuis un canal secondaire pour lequel une requête de canal secondaire n'est pas disponible.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)