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1. (WO2005122356) ELECTROSTATIC DISCHARGE PROTECTION CIRCUIT
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2005/122356    International Application No.:    PCT/US2005/016101
Publication Date: 22.12.2005 International Filing Date: 06.05.2005
IPC:
H02H 9/00 (2006.01)
Applicants: ALTERA CORPORATION [US/US]; 101 Innovation Drive, San Jose, CA 94301 (US) (For All Designated States Except US).
HUANG, Cheng-Hsiung [US/US]; (US) (For US Only).
LIN, Guu [US/US]; (US) (For US Only).
LEE, Shih-Lin, S. [US/US]; (US) (For US Only).
SHIH, Chih-Ching [US/US]; (US) (For US Only).
RAHIM, Irfan [US/US]; (US) (For US Only).
TRAN, Stephanie, T. [US/US]; (US) (For US Only)
Inventors: HUANG, Cheng-Hsiung; (US).
LIN, Guu; (US).
LEE, Shih-Lin, S.; (US).
SHIH, Chih-Ching; (US).
RAHIM, Irfan; (US).
TRAN, Stephanie, T.; (US)
Agent: TREYZ, Victor, G.; Suite 984, 870 Market Street, San Francisco, CA 94102 (US)
Priority Data:
10/861,604 03.06.2004 US
Title (EN) ELECTROSTATIC DISCHARGE PROTECTION CIRCUIT
(FR) CIRCUIT DE PROTECTION CONTRE LES DECHARGES ELECTROSTATIQUES
Abstract: front page image
(EN)Integrated circuits are provided that have sensitive circuitry such as programmable polysilicon fuses (56). Electrostatic discharge (ESD) protection circuitry (40) is provided that prevents damage or undesired programming of the sensitive circuitry in the presence of an electrostatic discharge event. The electrostatic discharge protection circuitry may have a power ESD device (44) that limits the voltage level across the sensitive circuitry to a maximum voltage and that draws current away from the sensitive circuitry when exposed to ESD signals. The electrostatic discharge protection circuitry may also have an ESD margin circuit (42) that helps to prevent current flow through the sensitive circuitry when the maximum voltage is applied across the sensitive circuitry.
(FR)L'invention concerne des circuits intégrés comportant des circuits sensibles tels que des fusibles programmables en polysilicium. Des circuits de protection contre les décharges électrostatiques (ESD) sont utilisés pour éviter des dégâts ou une programmation non voulue des circuits sensibles en présence d'un événement du type décharge électrostatique. Les circuits de protection contre les décharges électrostatiques peuvent comporter un dispositif ESD de puissance qui limite le niveau de la tension à travers les circuits sensibles à une tension maximale et qui soutire un courant de ces circuits sensibles quand ceux-ci sont exposés aux signaux ESD. Le circuit de protection contre les décharges électrostatiques peut également comporter un circuit de marge ESD qui aide à prévenir le passage du courant à travers les circuits sensibles quand la tension maximale est appliquée à travers ces circuits sensibles.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, MC, NL, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)