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1. (WO2005119461) LOGGING OF LEVEL-TWO CACHE TRANSACTIONS INTO BANKS OF THE LEVEL-TWO CACHE FOR SYSTEM ROLLBACK
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2005/119461    International Application No.:    PCT/US2005/019825
Publication Date: 15.12.2005 International Filing Date: 03.06.2005
IPC:
G06F 12/00 (2006.01)
Applicants: SUN MICROSYSTEMS, INC. [US/US]; 4150 Network Circle, Santa Clara, CA 95054 (US)
Inventors: CHAUDHRY, Shailender; (US).
JACOBSON, Quinn, A.; (US).
SAULSBURY, Ashley; (US)
Agent: GUNNISON, Forrest; Gunnison, McKay & Hodgson, L.L.P., 1900 Garden Road, Suite 200, Monterey, CA 93940 (US)
Priority Data:
60/576,959 04.06.2004 US
60/576,958 04.06.2004 US
11/144,097 02.06.2005 US
Title (EN) LOGGING OF LEVEL-TWO CACHE TRANSACTIONS INTO BANKS OF THE LEVEL-TWO CACHE FOR SYSTEM ROLLBACK
(FR) JOURNALISATION DE TRANSACTIONS DE MEMOIRE CACHE DE NIVEAU DEUX DANS DES BANQUES DE LADITE MEMOIRE CACHE POUR RETOUR ARRIERE D'UN SYSTEME
Abstract: front page image
(EN)A plurality of processors (210_0, 210_1) on a chip (200) is operated in lockstep. A crossbar switch (220) on chip (200) couples and decouples the plurality of processors (210_0, 210 1) to a plurality of banks (230_0, 230_1) in a level-two (L2) cache (230). As data is stored in a first bank (230_0) of L2 cache (230), the old data at that location is passed through crossbar switch (220) to a second bank (230_2) of L2 cache (230) that is functioning as a first-in-first-out memory (FIFO). Thus, new data is cached at a location in first bank (230_0) of the level-two cache (230), i.e., stored, and old data, from that location, is logged in second bank (230_2) of level-two cache (230). The logged data in second bank (230_2) is used to restore first bank (230_0) to a known prior state when necessary.
(FR)Selon la présente invention, une pluralité de processeurs (210_0, 210_1) sur une puce (200) fonctionne dans une étape de verrouillage. Un commutateur crossbar (220) sur une puce (200) permet de coupler et de découpler la pluralité de processeurs 210_0, 210_1) d'une pluralité de banques (230_0, 230_1) dans une mémoire cache (230) de niveau deux (L2). A mesure que des données sont stockées dans une première banque (230_0) de la mémoire cache (L2) (230), les anciennes données à cet emplacement sont acheminées par le biais d'un commutateur crossbar (220) jusqu'à une seconde banque (230_2) de la mémoire cache L2 (230) qui fonctionne comme une mémoire premier entré premier sorti (FIFO). Ainsi, de nouvelles données sont mises en mémoire cache à un emplacement dans une première banque (230_0) de la mémoire cache de niveau deux (230), à savoir, stockées, et des anciennes données provenant de cet emplacement sont consignées dans une seconde banque (230_2) de la mémoire cache de niveau deux (230). Les données consignées dans la seconde banque (230_2) sont utilisées afin de restaurer la première banque (230_0) à un état antérieur connu, lorsque cela est nécessaire.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, UZ, VC, VN, YU, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, MC, NL, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)