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Pub. No.:    WO/2005/062168    International Application No.:    PCT/US2004/038987
Publication Date: 07.07.2005 International Filing Date: 19.11.2004
G06F 9/38 (2006.01), G06F 9/48 (2006.01), G06F 9/40 (2006.01)
Applicants: INTEL CORPORATION [US/US]; 2200 Mission College Boulevard, Santa Clara, CA 95052 (US) (For All Designated States Except US).
WANG, Perry [US/US]; (US) (For US Only).
WANG, Hong [US/US]; (US) (For US Only).
SHEN, John [US/US]; (US) (For US Only).
SESHADRI, Ashok [US/US]; (US) (For US Only).
MAH, Anthony [US/US]; (US) (For US Only).
GREENE, William [US/US]; (US) (For US Only).
CHANDRA, Ravi [US/US]; (US) (For US Only).
DESAI, Piyush [IN/US]; (US) (For US Only).
LIAO, Steve, Shih-wei [--/US]; (US) (For US Only)
Inventors: WANG, Perry; (US).
WANG, Hong; (US).
SHEN, John; (US).
SESHADRI, Ashok; (US).
MAH, Anthony; (US).
GREENE, William; (US).
CHANDRA, Ravi; (US).
DESAI, Piyush; (US).
LIAO, Steve, Shih-wei; (US)
Agent: VINCENT, Lester, J.; Blakely Sokoloff Talyor & Zafman, 12400 Wilshire Boulevard, 7th Floor, Los Angeles, CA 90025 (US)
Priority Data:
10/728,649 05.12.2003 US
Abstract: front page image
(EN)A virtual multithreading hardware mechanism provides multi-threading on a single-threaded processor. Thread switches are triggered by user-defined triggers. Synchronous triggers may be defined in the form of special trigger instructions. Asynchronous triggers may be defined via special marking instructions that identify an asynchronous trigger condition. The asynchronous trigger condition may be based on a plurality of atomic processor events. Minimal context information, such as only an instruction pointer address, is maintained by the hardware upon a thread switch. In to contrast to traditional simultaneous multithreading schemes, the virtual multithreading hardware provides thread switches that are transparent to an operating system and that may be performed without operating system intervention.
(FR)L'invention concerne un mécanisme matériel de traitement multifilière offrant un traitement multifilière sur un processeur à filière unique. Les commutateurs de filière sont déclenchés par des déclencheurs définis par l'utilisateur. Les déclencheurs synchrones peuvent être définis sous forme d'instructions de déclencheur spéciales. Les déclencheurs asynchrones peuvent être définis via des instructions de marquage spéciales qui identifient une condition de déclencheur asynchrone. La condition de déclencheur asynchrone peut être basée sur plusieurs événements de processeur atomique. L'information de contexte minimale telle qu'une seule adresse de pointeur d'instruction, est conservé par le matériel lors de la commutation de filière. A l'opposé des schémas multifilières simultanés traditionnels, le matériel multifilière virtuel offre des commutations de filière transparentes à un système de fonctionnement et celles-ci peuvent être mises en oeuvre sans intervention du système de fonctionnement.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LU, MC, NL, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)