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1. (WO2005015763) READING METHOD, RESPONDER, AND INTERROGATOR
Latest bibliographic data on file with the International Bureau   

Pub. No.: WO/2005/015763 International Application No.: PCT/JP2003/010211
Publication Date: 17.02.2005 International Filing Date: 11.08.2003
Chapter 2 Demand Filed: 24.09.2003
IPC:
G06K 7/00 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
K
RECOGNITION OF DATA; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
7
Methods or arrangements for sensing record carriers
Applicants: USAMI, Mitsuo[JP/JP]; JP (UsOnly)
HITACHI, LTD.[JP/JP]; 6-6, Marunouchi 1-chome Chiyoda-ku Tokyo 100-8280, JP (AllExceptUS)
Inventors: USAMI, Mitsuo; JP
Agent: SAKUTA, Yasuo; c/o Hitachi, Ltd. 5-1, Marunouchi 1-chome Chiyoda-ku, Tokyo 100-8220, JP
Priority Data:
Title (EN) READING METHOD, RESPONDER, AND INTERROGATOR
(FR) PROCEDE DE LECTURE, REPONDEUR ET INTERROGATEUR
(JA) 読み出し方法および応答器および質問器
Abstract:
(EN) There has been a problem involved in the prior art that complex commands, a large number of operation stages, complex flip-flops, control of switching of transmission/reception, control of a memory address counter, complex logical circuits such as a data comparator circuit are needed to repeat transmission/reception of a recognition number to/from an interrogator in units of one bit, and the chip size cannot be reduced. When a carrier of high frequency modulated with clock pulses is sent from an antenna of an interrogator for reading a recognition number in a responder through radio to the responder, a first sequence of clock pulses with short intervals therebetween and a second sequence of clock pulses with long intervals therebetween are combined so as to control the reading of the recognition number by the interrogator. Thus, the size of the semiconductor chip of the responder can be reduced, suppressing an increase of the cost of the semiconductor chip.
(FR) L'état de la technique pose le problème qu'il nécessite des commandes complexes, un nombre élevé d'étages de fonctionnement, des bascules complexes, la commande de la commutation émission/réception, la commande d'un compteur d'adresse de mémoire et des circuits logiques complexes, un circuit de comparaison de données par exemple, pour répéter l'émission/réception d'un numéro de reconnaissance vers et depuis un interrogateur en unités d'un bit, et que la taille de la puce ne peut pas être réduite. Selon l'invention, lorsqu'une porteuse haute fréquence modulée par des impulsions d'horloge est envoyée par radio d'une antenne d'un interrogateur au répondeur pour lire un numéro de reconnaissance dans un répondeur, une première séquence d'impulsions d'horloge séparées par de courts intervalles et une deuxième séquence d'impulsions d'horloge séparées par de longs intervalles sont combinées de façon à commander la lecture du numéro de reconnaissance par l'interrogateur. Il est ainsi possible de réduire la taille de la puce semi-conductrice du répondeur, ce qui empêche une augmentation du coût de la puce semi-conductrice.
(JA) 従来技術では、認識番号を1ビット単位に質問器と送受信を繰り返すため、複雑なコマンド、多くの動作ステージ数、複雑なフリップフロップ、送受信の切り替えの制御、メモリアドレスカウンタの制御、データの比較回路等の複雑な論理回路を必要としチップサイズが抑えられないという問題点があった。本願においては、無線により応答器の中にある認識番号を読み取る質問器と当該の応答器があり、当該の質問器のアンテナから当該の応答器に対して高周波数の搬送波にクロックパルスを変調して送出するとき、当該のクロックパルスの間隔が短い第1の場合と当該のクロックパルスの間隔が長い第2の場合を持ち、第1の場合のクロックパルスと第2の場合のクロックパルスを組み合わせにより、質問器から当該の認識番号の読み取りを制御することにより、応答器の半導体チップサイズの小型化を実現し、半導体チップのコスト上昇を抑える。
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Publication Language: Japanese (JA)
Filing Language: Japanese (JA)