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1. (WO2004097868) CHARGE BALANCING CIRCUIT FOR DOUBLE-LAYER CAPACITORS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2004/097868    International Application No.:    PCT/US2004/010795
Publication Date: 11.11.2004 International Filing Date: 05.04.2004
IPC:
H02J 7/00 (2006.01), H02J 7/34 (2006.01)
Applicants: MAXWELL TECHNOLOGIES, INC. [US/US]; 9244 Balboa Avenue, San Diego, CA 92123 (US) (For All Designated States Except US).
THRAP, Guy, C. [US/US]; (US) (For US Only).
GALLAY, Roland [CH/CH]; (CH) (For US Only).
SCHLUNKE, Daniel [CH/CH]; (CH) (For US Only)
Inventors: THRAP, Guy, C.; (US).
GALLAY, Roland; (CH).
SCHLUNKE, Daniel; (CH)
Agent: KOENER, Gregory, J.; Redwood Patent Law 1291 East Hillsdale Boulevard Suite 205 Foster City, CA 94404 (US)
Priority Data:
10/423,708 25.04.2003 US
60/498,197 26.08.2003 US
60/518,052 07.11.2003 US
60/518,421 07.11.2003 US
Title (EN) CHARGE BALANCING CIRCUIT FOR DOUBLE-LAYER CAPACITORS
(FR) CIRCUIT D'EQUILIBRAGE DE CHARGE POUR CONDENSATEURS DOUBLE COUCHE
Abstract: front page image
(EN)A charge balancing circuit (32) is configured to provide charge balancing for a bank (10) of series connected charge storage devices (12, 14). One embodiment of the charge balancing circuit comprises a voltage divider (36), an amplifier (34), and a negative feedback resistor (40) connected between every two capacitors. The circuit is configured to monitor the voltage in each of the capacitors and, if the voltage in one of the capacitors is higher than the other, the circuit transfers energy from the higher charged capacitor to the lower charged capacitor until the capacitors are balanced. A current limiting resistor (38) can be included for limiting the output current of the amplifier to a safe value and for providing feedback information regarding the health of the capacitor. An additional gain stage can also be included for increasing the output current of the amplifier for banks of large charge storage devices.
(FR)L'invention concerne un circuit d'équilibrage de charge configuré pour assurer un équilibrage de charge à un banc de dispositifs de stockage de charges connectés en série. Dans un mode de réalisation, le circuit d'équilibrage de charge comprend un diviseur de tension, un amplificateur, et une résistance de réaction négative connectés entre chaque paire de condensateurs. Le circuit est configuré pour surveiller la tension dans chaque condensateur et, si la tension dans un condensateur est supérieure à la tension dans l'autre condensateur, le circuit transfère de l'énergie du condensateur le plus chargé au condensateur le moins chargé jusqu'à ce que les condensateurs s'équilibrent. Une résistance de limitation du courant peut être incluse pour limiter le courant de sortie de l'amplificateur à une valeur sûre et pour fournir une information rétroactive concernant la santé du condensateur. Un étage de gain complémentaire peut également être inclus pour augmenter le courant de sortie de l'amplificateur pour des bancs de dispositifs à grande capacité de stockage de charges. Le circuit de l'invention peut être utilisé dans des applications bipolaires.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)