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1. (WO2004095211) DATA STORAGE SYSTEM
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2004/095211    International Application No.:    PCT/US2004/005731
Publication Date: 04.11.2004 International Filing Date: 26.02.2004
Chapter 2 Demand Filed:    30.07.2004    
IPC:
G06F 12/08 (2006.01), G06F 13/12 (2006.01), G06F 13/40 (2006.01)
Applicants: EMC CORPORATION [US/US]; 176 South Street, Hopkinton, MA 01748 (US) (For All Designated States Except US).
PORAT, Ofer [IL/US]; (US) (For US Only).
CAMPBELL, Brian, K. [US/US]; (US) (For US Only).
XU, Yujie [CN/US]; (US) (For US Only).
BRUNO, Eric, J. [US/US]; (US) (For US Only).
WILSON, Paul, C. [US/US]; (US) (For US Only)
Inventors: PORAT, Ofer; (US).
CAMPBELL, Brian, K.; (US).
XU, Yujie; (US).
BRUNO, Eric, J.; (US).
WILSON, Paul, C.; (US)
Agent: SHARKANSKY, Richard, M.; Daly, Crowley & Mofford, LLP, Suite 101, 275 Turnpike Street, Canton, MA 02021 (US).
MOFFORD, Donald, F.; Daly, Crowley & Mofford, LLP, 275 Turnpike Street, Suite 101, Canton, MA 02021-2310 (US)
Priority Data:
10/403,262 31.03.2003 US
Title (EN) DATA STORAGE SYSTEM
(FR) SYSTEME DE STOCKAGE DES DONNEES
Abstract: front page image
(EN)A system interface having a cache memory and directors. Each one of the directors includes a data pipe coupled between an input of such one of the directors. The data pipe includes a data pipe memory and a data pipe memory controller for controlling the data pipe memory. Each one of the directors includes microprocessor coupled to the data pipe memory controller. The system includes a switching network coupled to the cache memory to transfer data between the memory and: (a) the input of a selected one of the plurality of directors through the data pipe memory; (b) the microprocessor and the data pipe memory through the data pipe memory controller of a selected one of the plurality of directors; and (c) the microprocessor and the data pipe memory controller while by-passing the data pipe memory of a selected one of the plurality of directors.
(FR)Une interface système à antémémoire et directeurs. Chacun des directeurs comporte un canal de données couplé aux bornes d'une entrée de l'un de ces directeurs. Le canal de données comporte une mémoire de canal de données et un contrôleur de mémoire de canal de données servant à gérer la mémoire de canal de données. Chacun des directeurs comporte un microprocesseur couplé au contrôleur de mémoire de canal de données. Le système comporte un réseau de commutation couplé à l'antémémoire de façon à transférer des données entre la mémoire et: (a) l'entrée d'un directeur choisi dans la pluralité de données via la mémoire de canal de données; (b) le microprocesseur et la mémoire de canal de données via le contrôleur de mémoire de canal de données d'un directeur choisi parmi la pluralité de directeurs; et (c) le microprocesseur et le contrôleur de mémoire de canal de données tout en contournant la mémoire de canal de données d'un directeur choisi dans la pluralité de directeurs.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)