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1. (WO2004003714) CIRCUIT FOR DETECTION OF INTERNAL MICROPROCESSOR WATCHDOG DEVICE EXECUTION AND METHOD FOR RESETTING MICROPROCESSOR SYSTEM
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2004/003714    International Application No.:    PCT/PL2003/000058
Publication Date: 08.01.2004 International Filing Date: 17.06.2003
IPC:
G06F 1/24 (2006.01), G06F 11/00 (2006.01), G06F 11/07 (2006.01)
Applicants: ADVANCED DIGITAL BROADCAST POLSKA SP. ZO.O. [PL/PL]; ul. Trasa Pólnocna 16, PL-65-119 Zielona Góra (PL) (For All Designated States Except US).
ADVANCED DIGITAL BROADCAST LTD. [--/--]; 15F, 205, Section 3, Pei-Hsin Road, Hsin-Tien City, Taipei County, 231 Taiwan (TW) (For All Designated States Except US).
STABROWSKI, Marcin [PL/PL]; (PL) (For US Only)
Inventors: STABROWSKI, Marcin; (PL)
Agent: HUDY, Ludwik; Czernichów 4, PL-32-070 Czernichów, Kraków (PL)
Priority Data:
P-354827 01.07.2002 PL
Title (EN) CIRCUIT FOR DETECTION OF INTERNAL MICROPROCESSOR WATCHDOG DEVICE EXECUTION AND METHOD FOR RESETTING MICROPROCESSOR SYSTEM
(FR) CIRCUIT DE DETECTION DE L'EXECUTION D'UN DISPOSITIF DE SURVEILLANCE DE MICROPROCESSEUR INTERNE ET PROCEDE DE REMISE A ZERO DU SYSTEME DE MICROPROCESSEUR
Abstract: front page image
(EN)In a circuit for detection of internal microprocessor watchdog device execution comprising a microprocessor (6) with the internal watchdog device and with an input/output line (11) transmitting information about microprocessor reset, and a device for resetting the microprocessor system, to the input/output line (11) transmitting information about microprocessor (6) reset, a clock input CK is connected, which triggers the flip-flop (12), whose data input D and an inverted reset input /R are connected to the output of the device (19) for resetting the microprocessor system, and the inverted flip-flop (12) output /Q is connected to the input of the device (19^) for resetting the microprocessor system.
(FR)Dans un circuit destiné à détecter l'exécution d'un dispositif de surveillance de microprocesseur interne comprenant un microprocesseur (6) à dispositif de surveillance interne, une ligne d'entrée/sortie (11) permettant de transmettre des informations concernant la remise à zéro du microprocesseur, et un dispositif destiné à remettre à zéro le système de microprocesseur, une entrée d'horloge (CK) est reliée à la ligne d'entrée/sortie (11) ce qui permet de transmettre des informations concernant la remise à zéro du microprocesseur (6), lequel déclenche la bascule bistable (12), dont l'entrée des données D et une entrée de remise à zéro inversée/R sont connectées à la sortie du dispositif (19) en vue de remettre à zéro le système de microprocesseur, la sortie de bascule bistable inversée (12)/Q étant reliée à l'entrée du dispositif (19) en vue de remettre à zéro le système du microprocesseur.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, OM, PH, PT, RO, RU, SC, SD, SE, SG, SK, SL, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
African Regional Intellectual Property Organization (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)