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1. (WO2003077184) ARRAY TRANSFORMATION IN A BEHAVIORAL SYNTHESIS TOOL
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2003/077184    International Application No.:    PCT/US2003/007241
Publication Date: 18.09.2003 International Filing Date: 07.03.2003
IPC:
G06F 17/50 (2006.01)
Applicants: MENTOR GRAPHICS CORPORATION [US/US]; 8005 S.W. Boeckman Road, Wilsonville, OR 97070-7777 (US) (For All Designated States Except US).
PRAKASH, Shiva [IN/US]; (US) (For US Only).
BOWYER, Bryan, Darrell [US/US]; (US) (For US Only).
GUTBERLET, Peter, Pius [DE/US]; (US) (For US Only)
Inventors: PRAKASH, Shiva; (US).
BOWYER, Bryan, Darrell; (US).
GUTBERLET, Peter, Pius; (US)
Agent: SCOTTI, Robert, F.; Klarquist, Sparkman LLP, Suite 1600, One World Trade Center, 121 S.W. Salmon Street, Portland, OR 97204 (US)
Priority Data:
60/362,679 08.03.2002 US
Title (EN) ARRAY TRANSFORMATION IN A BEHAVIORAL SYNTHESIS TOOL
(FR) TRANSFORMATION DE TABLEAUX DANS UN OUTIL DE SYNTHESE COMPORTEMENTALE
Abstract: front page image
(EN)A behavioral synthesis tool (14) for generating an integrated circuit design. The tool allows a designer to interactively (18) allocate variables or arrays to memory resources without having to modify a source code description (12) of the integrated circuit (12). The tool reads the source code description (12) and generates a synthesis intermediate format (16) stored in memory. The tool searches the in-memory synthesis format to find arrays for each process. The arrays are then listed in a GUI (18). The GUI allows the designer to create memory resources, specifying the type of memory and packing mode. The designer is also provided with the ability to vary the format among a plurality of formats used to pack arrays to memory during the memory packing process. Upon completion of modifying the memory allocation, the designer saves the changes and such changes are effectuated by automatically updating the synthesis intermediate format.
(FR)L'invention concerne un outil de synthèse comportementale (14) servant au développement d'une conception de circuit intégré. Cet outil permet à un concepteur d'attribuer de façon interactive (18) des variables ou des tableaux à des ressources mémoire sans avoir à modifier une description de code source (12) du circuit intégré (12). Cet outil lit cette description de code source (12) et génère un format intermédiaire de synthèse (16) mis en mémoire. Cet outil recherche le format de synthèse mis en mémoire pour trouver des tableaux pour chaque processus. Ces tableaux sont listés dans une interface graphique utilisateur (18). Cette interface graphique utilisateur permet au concepteur de créer des ressources mémoire, en spécifiant le type de mémoire et le mode de tassement. Ce concepteur a aussi la possibilité de modifier un format parmi plusieurs formats utilisés pour tasser des tableaux dans une mémoire au cours du processus de tassement. Une fois l'attribution de mémoire terminée, ce concepteur enregistre les changements et ces changements sont effectués par une mise à jour automatique du format intermédiaire de synthèse.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NI, NO, NZ, OM, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
African Regional Intellectual Property Organization (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PT, RO, SE, SI, SK, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)