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Pub. No.:    WO/2003/073605    International Application No.:    PCT/JP2002/001881
Publication Date: 04.09.2003 International Filing Date: 28.02.2002
H03F 1/02 (2006.01), H03F 1/32 (2006.01), H03F 3/19 (2006.01), H03F 3/72 (2006.01)
Applicants: FUJITSU LIMITED [JP/JP]; 1-1, Kamikodanaka 4-chome, Nakahara-ku, Kawasaki-shi, Kanagawa 211-8588 (JP) (For All Designated States Except US).
SHIGAKI, Masafumi [JP/JP]; (JP) (For US Only)
Inventors: SHIGAKI, Masafumi; (JP)
Agent: ISHIDA, Takashi; A. AOKI, ISHIDA & ASSOCIATES, Toranomon 37 Mori Bldg., 5-1, Toranomon 3-chome, Minato-ku, Tokyo 105-8423 (JP)
Priority Data:
Abstract: front page image
(EN)A signal is branched after first amplifiers (12, 14 and 16) and before second amplifiers (20 and 22). When the signal is detected by a detection circuit (30), a gate bias circuit (32) switch the gate bias the FETs of the second amplifiers (20 and 22) to the voltage in a normal operation. When the signal is not detected no longer, the gate bias is switched to the voltage to suppress the power consumption after elapse of a mask time. In a distortion feedback high−frequency amplifier, the amplifier is brought into a substantially disconnected state by changing the gate bias of FETs as a means for disconnecting circuits for adjusting a distortion extraction circuit and a reverse distortion adding circuit.
(FR)L'invention concerne un signal provenant de premiers amplificateurs (12, 14 et 16) et venant avant des seconds amplificateurs (20 et 22). Lorsque le signal est détecté par un signal de détection (30), un circuit de polarisation de grille (32) commute la polarisation de grille des seconds amplificateurs (20 et 22) et passe à la tension dans un fonctionnement normal. Lorsque le signal n'est plus détecté, la polarisation de grille passe à la tension afin de supprimer la consommation de puissance après écoulement du temps de masque. Dans un amplificateur haute fréquence à rétroaction de distorsion, l'amplificateur atteint un état de déconnexion sensible par l'intermédiaire de la modification de la polarisation de grille des FET comme moyen de déconnexion des circuits afin de régler un circuit d'extraction de distorsion et un circuit d'addition de distorsion inverse.
Designated States: JP, US.
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)