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1. (WO2003063337) CMOS PHASE LOCKED LOOP WITH VOLTAGE CONTROLLED OSCILLATOR HAVING REALIGNMENT TO REFERENCE AND METHOD FOR THE SAME
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2003/063337    International Application No.:    PCT/US2002/001331
Publication Date: 31.07.2003 International Filing Date: 18.01.2002
IPC:
H03L 7/081 (2006.01), H03L 7/083 (2006.01), H03L 7/099 (2006.01), H03L 7/18 (2006.01)
Applicants: THE REGENTS OF THE UNIVERSITY OF CALIFORNIA [US/US]; 1111 Franklin Street, Oakland, CA 94607-5200 (US)
Inventors: YE, Sheng; (US).
GALTON, Ian; (US)
Agent: FALLON, Steven, P.; Greer, Burn & Crain, Ltd., Suite 2500, 300 S. Wacker Drive, Chicago, IL 60606 (US)
Priority Data:
Title (EN) CMOS PHASE LOCKED LOOP WITH VOLTAGE CONTROLLED OSCILLATOR HAVING REALIGNMENT TO REFERENCE AND METHOD FOR THE SAME
(FR) BOUCLE A PHASE ASSERVIE CMOS COMPORTANT UN OSCILLATEUR COMMANDE EN TENSION A REALIGNEMENT SUR REFERENCE ET PROCEDE ASSOCIE
Abstract: front page image
(EN)A periodic controlled realignment of the ring oscillator VCO (18) in a phase locked loop (10) is used to effect phase correction in a CMOS phase locked loop. A realignment to a buffered version of the reference signal is conducted periodically, at a time when an edge of the VCO waveform would ideally coincide with an edge in the reference signal. A preferred embodiment CMOS phase locked loop (10) of the invention uses a ring oscillator voltage controlled oscillator (18). A divide by M circuit (20) is driven by an output of the voltage controlled oscillator. A control voltage circuit accepts a reference signal and a signal from the divide by M circuit, and produces a control voltage proportional to a phase difference between the output of the voltage controlled oscillator and the reference signal to control the voltage controlled oscillator. A realignment circuit (14, 16) responsive to the reference signal provides realignment signal into the voltage controlled oscillator when an edge in the waveform of the voltage controlled oscillator ideally coincides with an edge of the reference signal.
(FR)Un oscillateur en anneau VCO (18) est réaligné périodiquement de manière commandée dans une boucle à phase asservie (10) pour mettre en oeuvre une correction de phase dans une boucle à phase asservie CMOS. Un réalignement sur une version tamponnée du signal de référence est mis en oeuvre périodiquement, au moment où un bord de la forme d'onde du VCO coïnciderait idéalement avec un bord du signal de référence. Une forme de réalisation préférée de boucle à phase asservie CMOS (10) utilise un oscillateur (18) en anneau commandé en tension. Un circuit (20) de division par M est excité par un signal de sortie de l'oscillateur commandé en tension. Un circuit de commande de tension reçoit un signal de référence et un signal provenant du circuit de division par M, et produit une tension de commande proportionnelle à une différence de phase entre le signal de sortie de l'oscillateur et le signal de référence pour commander l'oscillateur. Un circuit de réalignement (14, 16) sensible au signal de référence transmet un signal de réalignement à l'oscillateur lorsqu'un bord de la forme d'onde de l'oscillateur coïncide avec un bord du signal de référence.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CR, CU, CZ, DE, DK, DM, DZ, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, UZ, VN, YU, ZA, ZW.
African Regional Intellectual Property Organization (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)