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1. (WO2003003218) USING TYPE BITS TO TRACK STORAGE OF ECC AND PREDECODE BITS IN A LEVEL TWO CACHE
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2003/003218    International Application No.:    PCT/US2002/012768
Publication Date: 09.01.2003 International Filing Date: 02.04.2002
Chapter 2 Demand Filed:    18.12.2002    
IPC:
G06F 12/08 (2006.01)
Applicants: ADVANCED MICRO DEVICES, INC. [US/US]; One AMD Place, Mail Stop 68, P.O. Box 3453, Sunnyvale, CA 94088-3453 (US)
Inventors: ZURASKI, Gerald, D., Jr.; (US)
Agent: DRAKE, Paul, S.; Advanced Micro Devices, Inc., 5204 East Ben White Boulevard, Mail Stop 562, Austin, TX 78741 (US).
WRIGHT, Hugh, R.; Brookes Batchellor, 102-108 Clerkenwell Road, LondonEC1M 5SA (GB)
Priority Data:
09/892,328 26.06.2001 US
Title (EN) USING TYPE BITS TO TRACK STORAGE OF ECC AND PREDECODE BITS IN A LEVEL TWO CACHE
(FR) UTILISATION DE BITS TYPES POUR SUIVRE LE STOCKAGE DE CODES DE CORRECTION D'ERREUR ET PRECODER DES BITS DANS UNE ANTEMEMOIRE A DEUX NIVEAUX
Abstract: front page image
(EN)A microprocessor (10) configured to store victimized instruction and data bytes is disclosed. In one embodiment, the microprocessor includes a predecode unit (12), and instruction cache (16), a data cache (28), and a level two cache (50). The predecode unit received instruction bytes and generates corresponding predecode information that is stored in the instruction cache with the instruction bytes. The data cache received and stores data bytes. The level two cache is configured to receive and store victimized instruction bytes from the instruction cache along with parity information and predecode information, and victimized data bytes from the data cache along with error correction code bits. Indicator bits may be stored on a cache line basis to indicate the type of data is stored therein.
(FR)L'invention concerne un microprocesseur (10) configuré de façon à stocker des multiplets d'instructions et de données victimes d'erreurs. Dans un mode de réalisation, ledit microprocesseur comprend une unité de prédécodage (12), une antémémoire d'instructions (16), une antémémoire de données (28) et une antémémoire à deux niveaux (50). L'unité de précodage reçoit des multiplets d'instructions et génère des informations de précodage correspondantes stockées dans l'antémémoire d'instructions avec lesdits multiplets d'instructions. L'antémémoire de données reçoit et stocke des multiplets de données. L'antémémoire à deux niveaux est configurée de façon à recevoir et à stocker des multiplets d'instructions victimes d'erreurs provenant de l'antémémoire d'instructions ainsi que des informations de parité et des informations de prédécodage, et des multiplets de données victimes d'erreurs provenant de l'antémémoire de données ainsi que des bits de codes de correction d'erreur. Des bits d'indicateur peuvent être stockés sur la base d'une ligne d'antémémoire afin d'indiquer le type de données stockées dans ladite ligne.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, OM, PH, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TN, TR, TT, TZ, UA, UG, UZ, VN, YU, ZA, ZM, ZW.
African Regional Intellectual Property Organization (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)