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1. (WO2003002346) MEMBRANE SWITCH CIRCUIT LAYOUT AND METHOD FOR MANUFACTURING
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2003/002346    International Application No.:    PCT/US2002/020429
Publication Date: 09.01.2003 International Filing Date: 27.06.2002
IPC:
H01H 13/702 (2006.01)
Applicants: ICORP. [US/US]; 7101 31st Avenue North Minneapolis, MN 55427 (US).
NELSON, Wayne [US/US]; (US) (For US Only).
THEISEN, Joel [US/US]; (US) (For US Only).
PESONEN, John [US/US]; (US) (For US Only)
Inventors: NELSON, Wayne; (US).
THEISEN, Joel; (US).
PESONEN, John; (US)
Agent: BAUMAN, Mary, P.; Fredrikson & Byron, P.A. 1100 International Centre 900 2nd Ave. S. Minneapolis, MN 55402-3397 (US)
Priority Data:
09/895,933 29.06.2001 US
Title (EN) MEMBRANE SWITCH CIRCUIT LAYOUT AND METHOD FOR MANUFACTURING
(FR) CIRCUIT DE COMMUTATION MEMBRANAIRE ET SON PROCEDE DE FABRICATION
Abstract: front page image
(EN)A membrane switch circuit layout and method for producing a membrane switch circuit layout are disclosed. The membrane switch circuit layout may have two or more membrane layers. Each membrane has a top surface and a bottom surface. A conductive circuit trace is printed on the top surface of each membrane. The membrane layers are placed in a stack with each top membrane having thru-holes selectively cut there through. Thus, for example, in a layout having two membrane layers, the first membrane is positioned beneath the second membrane and he second membrane has thru-holes cut there through. Conductive ink may be pressed through the thru-holes to provide electrical connection between the circuit traces printed on the membrane layers. An adhesive may be placed between the membrane layers as either adhesive printed on one of the membrane layers or as an additional layer.
(FR)L'invention se rapporte à un circuit de commutation membranaire et à un procédé de production de ce dernier. Ledit circuit de commutation membranaire peut être doté de deux couches membranaires ou plus. Chaque membrane possède une surface supérieure et une surface inférieure. Un tracé de circuit conducteur est imprimé sur la surface supérieure de chaque membrane. Les couches membranaires sont empilées, chaque membrane supérieure étant traversée par des trous de passage percés sélectivement. Ainsi, par exemple, dans un circuit composé de deux couches membranaires, la première membrane est placée au-dessous de la seconde membrane, et la seconde membrane est traversée par des trous de passage. De l'encre conductrice peut être versée à travers les trous de passage afin d'assurer une liaison électrique entre les tracés de circuit imprimés sur les couches membranaires. Un adhésif peut être placé entre les couches membranaires, sous forme soit d'un adhésif imprimé sur l'une des couches membranaires, soit d'une couche supplémentaire.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, US, UZ, VN, YU, ZA, ZW.
African Regional Intellectual Property Organization (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)