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1. (WO2001026233) DIGITAL TO ANALOG CONVERTER TRIM APPARATUS AND METHOD
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2001/026233    International Application No.:    PCT/US2000/023348
Publication Date: 12.04.2001 International Filing Date: 24.08.2000
Chapter 2 Demand Filed:    25.04.2001    
IPC:
H03M 1/10 (2006.01), H03M 1/76 (2006.01)
Applicants: THE ENGINEERING CONSORTIUM, INC. [US/US]; 3000 Olcott Street, Santa Clara, CA 95054 (US)
Inventors: LITFIN, Helmuth, Robert; (US).
BECKER, Anthony, Joseph; (US).
BROWN, Clyde, Manford, Jr.; (US)
Agent: McCUBBREY, J., Bruce; Coudert Brothers, Suite 3300, Four Embarcadero Center, San Francisco, CA 94111 (US)
Priority Data:
09/410,111 30.09.1999 US
Title (EN) DIGITAL TO ANALOG CONVERTER TRIM APPARATUS AND METHOD
(FR) DISPOSITIF ET PROCEDE DE CORRECTION D'UN CONVERTISSEUR NUMERIQUE-ANALOGIQUE
Abstract: front page image
(EN)A digital to analog converter (300) has a decoder (350) configured to select weighted decoding elements (R1-RJ) in a decoding network. The decoded outputs increase in steps by a mathematical progression as a function of the value of the input to the decoder. A calibration circuit (360) adjusts the value of the digital input code received by the decoder to achieve a calibration function. In a programmable resistor embodiment, the value of the resistance selected by subsequent digital codes increases by a constant ratio. An adder (330) is used to add an offset value to the digital input, thereby shifting the value of the resistance selected by the decoder to compensate for fabrication variances.
(FR)L'invention concerne un convertisseur numérique-analogique (300) possédant un décodeur (350) configuré de manière à sélectionner des éléments de décodage pondérés (R1-RJ) dans une réseau de décodage. Les sorties décodées augmentent progressivement selon une progression mathématique fonction de la valeur d'entrée du décodeur. Un circuit d'étalonnage (360) ajuste la valeur du code d'entrée numérique reçu par le décodeur afin d'exécuter une fonction d'étalonnage. Dans le mode de réalisation d'un dispositif de résistance programmable, la valeur de résistance sélectionnée par des codes numériques subséquents augmente dans un rapport constant. Un additionneur (330) est utilisé pour ajouter une valeur de décalage à l'entrée numérique, décalant ainsi la valeur de résistance sélectionnée par le décodeur afin de compenser les variances dans la fabrication.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CR, CU, CZ, DE, DK, DM, DZ, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, UZ, VN, YU, ZA, ZW.
African Regional Intellectual Property Organization (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)