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1. (WO2001025898) DIGITAL MULTIPLY-ACCUMULATE CIRCUIT THAT CAN OPERATE ON BOTH INTEGER AND FLOATING POINT NUMBERS SIMULTANEOUSLY
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2001/025898    International Application No.:    PCT/US2000/024886
Publication Date: 12.04.2001 International Filing Date: 11.09.2000
Chapter 2 Demand Filed:    03.05.2001    
IPC:
G06F 7/44 (2006.01)
Applicants: CRADLE TECHNOLOGIES [US/US]; 3130 West Warren Avenue, Fremont, CA 94538 (US)
Inventors: WYLAND, David, C.; (US).
HARRISON, David, A.; (US)
Agent: SCHNECK, Thomas; Law Offices of Thomas Schneck, P.O. Box 2-E, San Jose, CA 95109-0005 (US)
Priority Data:
09/414,322 06.10.1999 US
Title (EN) DIGITAL MULTIPLY-ACCUMULATE CIRCUIT THAT CAN OPERATE ON BOTH INTEGER AND FLOATING POINT NUMBERS SIMULTANEOUSLY
(FR) CIRCUIT NUMERIQUE DE MULTIPLICATION-ACCUMULATION POUVANT TRAITER SIMULTANEMENT DES NOMBRES ENTIERS ET A VIRGULE FLOTTANTE
Abstract: front page image
(EN)A Multiply-Accumulate circuit (100) includes an exponent adder (140), a mantissa multiplier (142), a shifter (144), an adder (148), and an accumulator (152). The exponent adder receives two operands in a special combined data format which prescribes a mantissa and an exponent for both integer and floating point operands. The exponent adder adds the exponents. But if before the addition the exponent adder detects an integer as an operand, it replaces the exponent of the integer by a substitute value in that addition. This substitute value is related to the number of bits of the mantissa of the integer. The mantissa multiplier multiplies the two mantissa. The shifter shifts the resultant product of multiplication into a predefined fixed point format according to the resultant sum of the addition generated by the exponent adder. The adder adds this shifted product to the current content of the accumulator.
(FR)L'invention concerne un circuit (100) de multiplication-accumulation comprenant un additionneur (140) d'exposants, un multiplicateur (142) de mantisse, un décaleur (144), un additionneur (148), et un accumulateur (152). L'additionneur d'exposants reçoit deux opérandes dans un format de données combiné spécial qui établit une mantisse et un exposant pour les opérandes à nombre entier et à virgule flottante. L'additionneur d'exposants additionne les exposants mais si avant l'addition, l'additionneur d'exposant détecte un opérande à nombre entier, il remplace l'exposant du nombre entier par une valeur de substitution dans cette addition. Cette valeur de substitution est associée au nombre de bits de la mantisse du nombre entier. Le multiplicateur de mantisse multiplie les deux mantisses. Le décaleur décale le résultat de la multiplication en format à virgule fixe prédéfini en fonction de la somme de l'addition générée par l'additionneur d'exposants. L'additionneur additionne ce résultat décalé au contenu courant de l'accumulateur.
Designated States: JP.
European Patent Office (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE).
Publication Language: English (EN)
Filing Language: English (EN)