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1. (WO2001006711) DATA TRANSFER CONTROLLER AND ELECTRONIC DEVICE
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2001/006711    International Application No.:    PCT/JP2000/004638
Publication Date: 25.01.2001 International Filing Date: 12.07.2000
IPC:
H04L 12/46 (2006.01), H04L 12/64 (2006.01)
Applicants: SEIKO EPSON CORPORATION [JP/JP]; 4-1, Nishi-shinjuku 2-chome, Shinjuku-ku, Tokyo 163-0811 (JP) (For All Designated States Except US).
ISHIDA, Takuya [JP/JP]; (JP) (For US Only)
Inventors: ISHIDA, Takuya; (JP)
Agent: INOUE, Hajime; Ogikubo TM Bldg., 2nd Floor, 26-13, Ogikubo 5-chome, Suginami-ku, Tokyo 167-0051 (JP)
Priority Data:
11/201249 15.07.1999 JP
Title (EN) DATA TRANSFER CONTROLLER AND ELECTRONIC DEVICE
(FR) CONTROLEUR DE TRANSFERT DE DONNEES ET DISPOSITIF ELECTRONIQUE
Abstract: front page image
(EN)A data transfer controller reducing the overhead of a processing by firmware and realizing high-rate data transfer. The data transfer controller conforms to the IEEE 1394 standards. In the case of a header CRC error, the header pointer is returned to the previous position to invalidate a packet. In the case of an Unktcode, the packet is not written in a RAM to invalidate the packet, and the reception end status is not set up. A register for storing therein the status of the header CRC error is provided. In the case of a data CRC error, the header pointer is not returned, and the data pointer is returned to the previous position. A first mode in which a received broadcast packet is invalidated and a second mode in which the packet is validated can be set up. When a broadcast packet is received in the first mode, the packet is not written in a RAM. An electronic device is also disclosed.
(FR)L'invention concerne un contrôleur de transfert de données réduisant le surdébit lié au traitement par micrologiciel et effectuant un transfert rapide des données. Ledit contrôleur de transfert de données est conforme à la norme IEEE 1394. Dans le cas d'une erreur CRC (contrôle de redondance cyclique) d'en-tête, on renvoie le pointeur d'en-tête à la position antérieure pour invalider un paquet. Dans le cas d'un code Unktcode, le paquet n'est pas écrit dans une RAM en vue de son invalidation, et le statut fin de réception n'est pas établi. Un registre destiné à l'enregistrement du statut de l'erreur CRC d'en-tête est prévu. Dans le cas d'une erreur CRC de données, le pointeur d'en-tête n'est pas renvoyé, alors que le pointeur de données est renvoyé à la position antérieure. On peut alors établir un premier mode, selon lequel un paquet de diffusion reçu est invalidé, et un second mode, selon lequel le paquet est validé Lorsqu'un paquet de diffusion est reçu selon le premier mode, le paquet n'est pas écrit dans une RAM. L'invention concerne également un dispositif électronique.
Designated States: CN, KR, US.
European Patent Office (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)