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1. (WO2000060749) PROCESSOR AND PROCESSING METHOD
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2000/060749    International Application No.:    PCT/JP2000/001931
Publication Date: 12.10.2000 International Filing Date: 29.03.2000
IPC:
G06F 5/00 (2006.01), H03M 13/27 (2006.01)
Applicants: MATSUSHITA ELECTRIC INDUSTRIAL CO., LTD. [JP/JP]; 1006, Oaza Kadoma, Kadoma-shi, Osaka 571-8501 (JP) (For All Designated States Except US).
YAMANAKA, Ryutaro [JP/JP]; (JP) (For US Only)
Inventors: YAMANAKA, Ryutaro; (JP)
Agent: WASHIDA, Kimihito; 5th Floor, Shintoshicenter Bldg., 24-1, Tsurumaki 1-chome, Tama-shi, Tokyo 206-0034 (JP)
Priority Data:
11/97002 02.04.1999 JP
Title (EN) PROCESSOR AND PROCESSING METHOD
(FR) PROCESSEUR ET METHODE DE TRAITEMENT
Abstract: front page image
(EN)An interleave/deinterleave processing in which input data is arranged and stored in a storage area having continuous addresses of a RAM (103), the stored data is read with double precision in order of address of the RAM (103) according to the address of a first pointer (101) and the address from an address generator (102), one of the sets of data is stored in a storage area having even addresses of a RAM (110) according to the address of a second pointer (106) and the address from an address generator (107), and the other is stored in a storage area having odd addresses apart from the even addresses by predetermined distances of the RAM (110) according to the address of a third pointer (108) and the address from an address generator (109) is carried out in one machine cycle. In such a way, the digital signal processor is small-sized, formed into one chip, and manufactured at low cost, the power consumption of the battery of a portable terminal is small, and the portable terminal is lightweight and manufactured at low cost.
(FR)L'invention concerne une méthode de traitement, qui s'effectue en mode entrelacement/désentrelacement, en un seul cycle machine. Selon cette méthode, des données d'entrée sont mises en ordre et stockées dans une zone de stockage présentant des adresses continues d'une RAM (103). Les donnés stockées sont lues avec une double précision dans l'ordre des adresses de la RAM (103) par rapport à l'adresse d'un premier pointeur (101) et à l'adresse d'un générateur d'adresses (102). Un des ensembles de données est stocké dans une zone de stockage présentant des adresses paires d'une RAM (110) par rapport à l'adresse d'un deuxième pointeur (106) et à l'adresse d'un générateur d'adresses (107). L'autre ensemble de données est stocké dans une zone de stockage présentant des adresses impaires séparées des adresses paires par des distances préétablies de la RAM (110) par rapport à l'adresse d'un troisième pointeur (108) et à l'adresse d'un générateur d'adresses (109). Ainsi conçu, le processeur de signal numérique, de taille réduite, est formé à l'intérieur d'une puce et fabriqué à faible coût. La consommation d'énergie de la pile d'un terminal portatif est faible et l'on obtient un terminal portatif léger fabriqué à faible coût.
Designated States: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, CA, CH, CN, CR, CU, CZ, DE, DK, DM, DZ, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, US, UZ, VN, YU, ZA, ZW.
African Regional Intellectual Property Organization (GH, GM, KE, LS, MW, SD, SL, SZ, TZ, UG, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)