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1. (WO2000026740) METHOD AND APPARATUS FOR DIGITAL VOLTAGE REGULATION
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2000/026740    International Application No.:    PCT/US1999/025720
Publication Date: 11.05.2000 International Filing Date: 01.11.1999
Chapter 2 Demand Filed:    30.05.2000    
IPC:
H02M 3/157 (2006.01), H02M 3/158 (2006.01)
Applicants: VOLTERRA SEMICONDUCTOR CORPORATION [US/US]; Suite 202 42840 Christy Street Fremont, CA 94538 (US)
Inventors: BURNSTEIN, Andrew, J.; (US).
SCHULTZ, Aaron, M.; (US).
CHRISTENSON, Michael; (US).
LIDSKY, David, B.; (US).
STRATAKOS, Anthony; (US).
SULLIVAN, Charlie; (US).
CLARK, William; (US)
Agent: GOREN, David, J.; Fish & Richardson P.C. Suite 100 2200 Sand Hill Road Menlo Park, CA 94025 (US)
Priority Data:
09/183,325 30.10.1998 US
09/183,448 30.10.1998 US
09/183,326 30.10.1998 US
09/183,337 30.10.1998 US
Title (EN) METHOD AND APPARATUS FOR DIGITAL VOLTAGE REGULATION
(FR) TECHNIQUE ET DISPOSITIF DE GRADUATION NUMERIQUE DE LA TENSION
Abstract: front page image
(EN)A digital voltage regulator has an input terminal (20) coupled to an input voltage source (12), an output terminal (22) coupled to a load (14), and a plurality of switching circuits (24) to alternately couple and decouple the input terminal (20) to the output terminal (22). An estimated current is calculated for each switching circuit (24), each estimated current representing a current passing through an inductor (34) associated with the switching circuit (24). A total desired output current to pass throught the inductor (34) is calculated which will maintain an output voltage at the output terminal (22) substantially constant. The switching circuits (24) are controlled based on the estimated current and the total desired output current so that a total current passing through the inductor (34) is approximately equal to the total desired output current.
(FR)Graduateur de tension numérique possédant un terminal d'entrée (20) couplé à une source de tension d'entrée (12), un terminal de sortie (22) couplé à une charge (14), et une pluralité de circuits de commutation (24) permettant de relier et de séparer le terminal d'entrée (20) et le terminal de sortie (22). Un courant estimé est calculé pour chaque circuit de commutation (24), chaque courant estimé représentant un courant traversant une inductance (34) associée au circuit de commutation. Le courant total de sortie désiré devant traverser l'inductance (34), est calculé de sorte qu'il puisse maintenir la tension de sortie du terminal de sortie (22) sensiblement constante. Les circuits de commutation (24) sont commandés en fonction du courant estimé et du courant de sortie total désiré de telle manière que le courant total traversant l'inductance (34) soit à peu près égal au courant de sortie total souhaité.
Designated States: AE, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, CA, CH, CN, CR, CU, CZ, DE, DK, DM, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, UZ, VN, YU, ZA, ZW.
African Regional Intellectual Property Organization (GH, GM, KE, LS, MW, SD, SL, SZ, TZ, UG, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)