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1. WO1999060702 - LOW POWER COUNTERS

Publication Number WO/1999/060702
Publication Date 25.11.1999
International Application No. PCT/SE1999/000804
International Filing Date 12.05.1999
Chapter 2 Demand Filed 13.12.1999
IPC
H03K 23/00 2006.01
HELECTRICITY
03BASIC ELECTRONIC CIRCUITRY
KPULSE TECHNIQUE
23Pulse counters comprising counting chains; Frequency dividers comprising counting chains
H03K 23/58 2006.01
HELECTRICITY
03BASIC ELECTRONIC CIRCUITRY
KPULSE TECHNIQUE
23Pulse counters comprising counting chains; Frequency dividers comprising counting chains
58Gating or clocking signals not applied to all stages, i.e. asynchronous counters
CPC
H03K 23/005
HELECTRICITY
03BASIC ELECTRONIC CIRCUITRY
KPULSE TECHNIQUE
23Pulse counters comprising counting chains; Frequency dividers comprising counting chains
004Counters counting in a non-natural counting order, e.g. random counters
005using minimum change code, e.g. Gray Code
H03K 23/58
HELECTRICITY
03BASIC ELECTRONIC CIRCUITRY
KPULSE TECHNIQUE
23Pulse counters comprising counting chains; Frequency dividers comprising counting chains
58Gating or clocking signals not applied to all stages, i.e. asynchronous counters
Applicants
  • TELEFONAKTIEBOLAGET LM ERICSSON [SE]/[SE]
Inventors
  • HANSSON, Mattias
Agents
  • STRÖM, Tore
Priority Data
9801738-718.05.1998SE
Publication Language English (EN)
Filing Language English (EN)
Designated States
Title
(EN) LOW POWER COUNTERS
(FR) COMPTEURS FAIBLE PUISSANCE
Abstract
(EN)
A low power counter for cycling through a predetermined sequence of states in response to pulses on an input line ($i(en)), including a number of counter blocks, corresponding to the number of bits of the counter, connected in series. The low power counter blocks comprise memory means (101-104; 201, 207; 401-408; 501, 502, 513, 514) consuming a minimum of power when they are disabled and are activated only when the value of the respective data output connection (q) has to be changed.
(FR)
L'invention concerne un compteur faible puissance, destiné à passer par une séquence d'états préalablement déterminée en réponse aux impulsions subies par une ligne d'entrée ($i(en)). Ce compteur comprend plusieurs blocs compteurs, correspondant au nombre de bits du compteur, ces différents blocs étant montés en série. Ces blocs compteurs faible puissance comprennent des organes mémoire (101-104; 201, 207; 401-408; 501, 502, 513, 514), qui consomment peu d'énergie une fois mis hors service, ces organes mémoire n'étant activés que lorsque la valeur de chaque connexion de sortie des données (q) doit être modifiée.
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