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1. (WO1999010802) A RECONFIGURABLE ARITHMETIC DATAPATH
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/1999/010802    International Application No.:    PCT/US1998/017946
Publication Date: 04.03.1999 International Filing Date: 27.08.1998
Chapter 2 Demand Filed:    18.03.1999    
IPC:
G06F 7/52 (2006.01), G06F 7/544 (2006.01)
Applicants: MALLEABLE TECHNOLOGIES, INC. [US/US]; Suite 104 2880 Zanker Road San Jose, CA 95134-2121 (US) (AL, AM, AT, AU, AZ, BA, BB, BE, BF, BG, BJ, BR, BY, CA, CF, CG, CH, CI, CM, CN, CU, CY, CZ, DE, DK, EE, ES, FI, FR, GA, GB, GE, GH, GM, GN, GR, GW, HR, HU, ID, IE, IL, IS, IT, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MC, MD, MG, MK, ML, MN, MR, MW, MX, NE, NL, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, SN, SZ, TD, TG, TJ, TM, TR, TT, UA, UG, UZ, VN, YU, ZW only).
ABBOTT, Curtis [US/US]; (US) (For US Only)
Inventors: ABBOTT, Curtis; (US)
Agent: DE VOS, Daniel, M.; Blakely, Sokoloff, Taylor & Zafman LLP 7th floor 12400 Wilshire Boulevard Los Angeles, CA 90025 (US)
Priority Data:
60/057,156 28.08.1997 US
08/953,766 17.10.1997 US
Title (EN) A RECONFIGURABLE ARITHMETIC DATAPATH
(FR) CHEMIN DE DONNEES ARITHMETIQUE RECONFIGURABLE
Abstract: front page image
(EN)A method and apparatus that combine the same basic hardware elements in several ways to perform a plurality of arithmetic operations over different numbers of operands of different lengths. The allowed options include the multiplication (120) and summing of several operands in a single operation. The reuse of ha rdware elements is obtained by the use of a multiplication hardware (120) structure together with multiplexer (122) logic (or similar selection logic) at appropriate points in the hardware structure, which allows a minimum of extra hardware and a small number of extra gate delays along any critical path, thereby ensuring that the flexibility to use different operand lengths and numbers of operands incurs only a small penalty in processing speed and/or chip area in a VLSI circuit implementation.
(FR)L'invention concerne un procédé et un appareil servant à combiner les mêmes éléments de matériel de base de différentes manières afin d'effectuer plusieurs opérations arithmétiques sur différents nombres d'opérandes de différentes longueurs. Les options autorisées comprennent la multiplication (120) et la sommation de plusieurs opérandes en une seule opération. La réutilisation d'éléments de matériel est obtenue par le recours à une structure de matériel (120) de multiplication, conjointement avec une logique de multiplexeur (122) (ou une logique de sélection similaire), à des points appropriés de la structure de matériel, ce qui nécessite un minimum de matériel supplémentaire et peu de temps de propagation supplémentaires sur tous les chemins critiques; et permet d'assurer par ce moyen que la flexibilité qu'offre l'utilisation d'opérandes de différentes longueurs et de différents nombres d'opérandes n'a que peu de conséquences sur la vitesse de traitement et/ou la surface de circuit occupée dans une installation de circuits VLSI.
Designated States: AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, CA, CH, CN, CU, CZ, DE, DK, EE, ES, FI, GB, GE, GH, GM, HR, HU, ID, IL, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MD, MG, MK, MN, MW, MX, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, UA, UG, US, UZ, VN, YU, ZW.
African Regional Intellectual Property Organization (GH, GM, KE, LS, MW, SD, SZ, UG, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)