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1. (WO1997022920) MICROARCHITECTURE FOR INDICATING THAT THE PACKED DATA STATE IS FULL OR EMPTY
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/1997/022920    International Application No.:    PCT/US1996/020516
Publication Date: 26.06.1997 International Filing Date: 17.12.1996
Chapter 2 Demand Filed:    03.07.1997    
IPC:
G06F 9/30 (2006.01), G06F 9/302 (2006.01)
Applicants: INTEL CORPORATION [US/US]; 2200 Mission College Boulevard, Santa Clara, CA 95052 (US) (For All Designated States Except US).
BISTRY, David [IL/US]; (US) (For US Only).
MENNEMEIER, Larry, M. [US/US]; (US) (For US Only).
PELEG, Alexander, D. [IL/US]; (IL) (For US Only).
DULONG, Carole [FR/US]; (US) (For US Only).
KOWASHI, Eiichi [JP/JP]; (JP) (For US Only).
MITTAL, Millind [US/US]; (US) (For US Only).
EITAN, Benny [IL/US]; (IL) (For US Only)
Inventors: BISTRY, David; (US).
MENNEMEIER, Larry, M.; (US).
PELEG, Alexander, D.; (IL).
DULONG, Carole; (US).
KOWASHI, Eiichi; (JP).
MITTAL, Millind; (US).
EITAN, Benny; (IL)
Agent: TAYLOR, Edwin, H.; Blakely, Sokoloff, Taylor & Zafman L.L.P., 7th floor, 12400 Wilshire Boulevard, Los Angeles, CA 90025 (US)
Priority Data:
08/575,686 19.12.1995 US
Title (EN) MICROARCHITECTURE FOR INDICATING THAT THE PACKED DATA STATE IS FULL OR EMPTY
(FR) MICROARCHITECTURE INDIQUANT L'ETAT PLEIN OU VIDE DES DONNEES CONDENSEES
Abstract: front page image
(EN)An apparatus (unit 605) comprising a plurality of tags (unit 620) associated with a first storage area indicating that locations in the first storage area are either empty or non-empty responsive to execution of floating point instructions which modify data contained in the first storage area. A first circuit is coupled to the plurality of tags which sets only the plurality of tags to an empty state responsive to receipt of a first instruction. The first instruction indicates termination of execution of instructions which operate upon the packed data (unit 610) stored in the first storage area. The apparatus further comprises a second circuit coupled to the plurality of tags for setting the plurality of tags to a non-empty state responsive to receipt of a second instruction. The second instruction specifies an operation upon packed data. The second circuit sets the plurality of tags to indicate execution of instructions which operate upon the packed data. This apparatus provides an architecture for clearing the packed data state at the end of executed blocks of packed data instructions to leave the floating point state in a clear condition for subsequent operations.
(FR)L'invention concerne un appareil (unité 605) comprenant plusieurs étiquettes (unité 620) associées à une première zone de mémorisation. Ces zones indiquent que des emplacements dans la première zone de mémorisation sont vides ou non vides en réponse à l'exécution d'instructions à virgule flottante qui modifient les données stockées dans la première zone de mémorisation. Un premier circuit est couplé aux étiquettes et les fait passer à un état vide lors de la réception d'une première instruction. Cette dernière indique la fin de l'exécution d'instructions qui fonctionnent sur les données condensées (unité 610) stockées dans la première zone de mémorisation. L'appareil comprend, en outre, un deuxième circuit est couplé aux étiquettes et les fait passer à un état non vide lors de la réception d'une deuxième instruction. Cette deuxième instruction spécifie une opération sur les données condensées. Le deuxième circuit règle les étiquettes pour indiquer l'exécuation d'instructions qui agissent sur les données condensées. Cet appareil présente une architecture pour remettre à zéro l'état des données condensées à la fin des blocs d'instructions de données condensées exécutés pour laisser la virgule flottante dans un état remis à zéro pour les opérations ultérieures.
Designated States: AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, CA, CH, CN, CU, CZ, DE, DK, EE, ES, FI, GB, GE, HU, IL, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MD, MG, MK, MN, MW, MX, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, TJ, TM, TR, TT, UA, UG, US, UZ, VN.
African Regional Intellectual Property Organization (KE, LS, MW, SD, SZ, UG)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, CH, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)