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1. (WO1997018514) ARCHITECTURE FOR PROCESSING BIT-MAP DATA FOR A RASTER PRINTER
Latest bibliographic data on file with the International Bureau

Pub. No.: WO/1997/018514 International Application No.: PCT/US1996/018430
Publication Date: 22.05.1997 International Filing Date: 12.11.1996
Chapter 2 Demand Filed: 11.06.1997
IPC:
G06F 3/12 (2006.01) ,G06K 15/00 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
3
Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
12
Digital output to print unit
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
K
RECOGNITION OF DATA; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
15
Arrangements for producing a permanent visual presentation of the output data
Applicants:
VARIS CORPORATION [US/US]; 7500 Innovation Way Mason, OH 45040, US
Inventors:
GAUTHIER, Forrest, P.; US
JOVIC, Dimitrije, L.; US
Agent:
LEVY, Mark, P. ; Thompson Hine & Flory L.L.P. 2000 Courthouse Plaza N.E. P.O. Box 8801 Dayton, OH 45401-8801, US
Priority Data:
08/558,00713.11.1995US
Title (EN) ARCHITECTURE FOR PROCESSING BIT-MAP DATA FOR A RASTER PRINTER
(FR) ARCHITECTURE POUR LE TRAITEMENT DES DONNEES EN MODE POINT DANS UNE IMPRIMANTE A TRAME
Abstract:
(EN) A digital high-speed printing system architecture for processing contiguous raster-image data blocks for transmission to a marking engine, comprises a central processing unit ('CPU') (42) and at least one video RAM device (44). Each video RAM device (44) includes a dynamic band RAM (46), a serial access memory (48), a random access port for transmitting and receiving image data blocks to and from the dynamic band RAM (46), and a serial port for transmitting and receiving image data blocks to and from the serial access memory (48). The video RAM devices (44) perform bi-directional image data block transfers between the dynamic band RAM (46) and the serial access memory (48). Furthermore, the video RAM devices (44) transfer image data blocks to and from the serial access port, and simultaneously transfer of image data blocks to and from the random access port.
(FR) L'invention concerne une architecture pour système d'impression numérique à grande vitesse visant à traiter des blocs de données vidéo contigus à balayage tramé en vue de leur transmission vers un moteur de marquage. Le système comprend une unité centrale de traitement ('CPU') (42) et au moins un dispositif à mémoire vive vidéo (44). Chaque dispositif à mémoire vive (44) comprend une mémoire vive à bande dynamique (46), une mémoire à accès séquentiel (48), un port d'accès aléatoire pour la transmission et la réception des blocs de données d'images avec la mémoire vive à bande dynamique (46), et un port d'accès série pour la transmission et la réception des blocs de données d'images avec la mémoire à accès séquentiel (48). La fonction des dispositifs à mémoire vive vidéo (44) consiste en un échange bidirectionnel des blocs de données d'images vidéo entre la mémoire vive à bande dynamique (46) et la mémoire à accès séquentiel (48). Par ailleurs, ce type de dispositif à mémoire vive (44) assure la transmission et la réception des blocs de données d'images vidéo avec le port d'accès séquentiel et aussi simultanément, avec le port d'accès aléatoire.
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African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, ML, MR, NE, SN, TD, TG)
Publication Language: English (EN)
Filing Language: English (EN)
Also published as:
EP0954789CA2237596AU1996076818