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1. (WO1996005557) ACCURATE DIGITAL FAULT TOLERANT CLOCK
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/1996/005557    International Application No.:    PCT/US1995/010231
Publication Date: 22.02.1996 International Filing Date: 10.08.1995
Chapter 2 Demand Filed:    20.02.1996    
IPC:
G06F 1/14 (2006.01), G06F 11/18 (2006.01)
Applicants: HONEYWELL INC. [US/US]; Honeywell Plaza, Minneapolis, MN 55408 (US)
Inventors: DRISCOLL, Kevin, R.; (US)
Agent: SHUDY, John, G., Jr.; Honeywell Inc., Honeywell Plaza - MN12-8251, P.O. Box 524, Minneapolis, MN 55440-0524 (US)
Priority Data:
08/289,728 12.08.1994 US
Title (EN) ACCURATE DIGITAL FAULT TOLERANT CLOCK
(FR) HORLOGE NUMERIQUE PRECISE INSENSIBLE AUX DEFAILLANCES
Abstract: front page image
(EN)This invention relates to fault-tolerant real-time clock capable of withstanding n-faults, including Byzantine faults. In particular, the instant invention produces redundant clock signals which have low skew with respect to each other, operate with extremely high accuracy, and can be constructed without use of analog electric components, with the exception of oscillators. The present fault tolerant clock is composed of three types of electrical subcircuits coupled together: oscillators/counters, sequential edge voters, and regular voters. Each of these cubcircuits can be duplicated and coupled appropriately as needed to form a clock mechanism tolerant of any number of faults in the clock circuitry while maintaining an extremely precise timing mechanism suitable for accurately integrating and differentiating signals with respect to time.
(FR)L'invention concerne une horloge en temps réel insensible aux défaillances pouvant résister à n défaillances dont les défaillances byzantines. L'horloge selon l'invention produit des signaux d'horloge redondants présentant une faible obliquité les uns par rapport aux autres et fonctionnant avec une grande précision, et peut être construite sans qu'il soit nécessaire d'utiliser des composants électriques analogiques, à l'exception des oscillateurs. Ladite horloge insensible aux défaillances se compose de trois types de sous-circuits électriques couplés les uns aux autres: oscillateurs/compteurs, votants marginaux séquentiels et votants réguliers. On peut dupliquer et coupler chaque sous-circuit de manière appropriée pour former un mécanisme d'horloge insensible à toute défaillance survenant dans les circuits d'horloge tout en conservant un mécanisme de synchronisation extrêmement précis convenant à l'intégration et à la différentiation précises de signaux en fonction du temps.
Designated States: CA, JP.
European Patent Office (AT, BE, CH, DE, DK, ES, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE).
Publication Language: English (EN)
Filing Language: English (EN)