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1. (WO1994027215) METHOD FOR DECODING GUEST INSTRUCTIONS FOR A HOST COMPUTER
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/1994/027215    International Application No.:    PCT/US1994/003911
Publication Date: 24.11.1994 International Filing Date: 08.04.1994
Chapter 2 Demand Filed:    05.12.1994    
IPC:
G06F 9/318 (2006.01), G06F 9/455 (2006.01)
Applicants: APPLE COMPUTER, INC. [US/US]; 20525 Mariani Avenue, Cupertino, CA 95014 (US) (For All Designated States Except US).
DAVIDIAN, Gary, G. [US/US]; (US) (For US Only)
Inventors: DAVIDIAN, Gary, G.; (US)
Agent: FLIESLER, Martin, C.; Fliesler, Dubb, Meyer and Lovejoy, Suite 400, Four Embarcadero Center, San Francisco, CA 94111-4156 (US)
Priority Data:
059,472 07.05.1993 US
Title (EN) METHOD FOR DECODING GUEST INSTRUCTIONS FOR A HOST COMPUTER
(FR) PROCEDE DE DECODAGE DES INSTRUCTIONS D'UN SYSTEME SOURCE DESTINEES A UN ORDINATEUR D'UN SYSTEME CIBLE
Abstract: front page image
(EN)A system for decoding guest instructions includes an emulation routine store in host processor addressable memory having a set of emulation programs beginning at corresponding emulation program addresses. A sequence of guest instructions is stored in the host processor addressable memory, and logic is provided which retrieves a current guest instruction in the sequence and jumps directly to an emulation program address in response to the current guest instruction. The emulation routine store is optimized by dividing it into a dispatch table having a set of dispatch entries and an emulation routine store storing a set of emulation entries. Each dispatch entry includes a plurality of host instructions of the emulation program corresponding to a particular guest instruction. The plurality of host instructions in a dispatch entry includes a host jump instruction which causes a jump to an emulation entry. The emulation entry stores a host instruction routine which includes host instructions to decode and prefetch guest instructions to form an emulation program address to a dispatch entry for a next guest instruction, and the jump directly to the dispatch entry.
(FR)Système de décodage d'instructions d'un système source comprenant une unité de stockage de programmes d'émulation qui est situé dans une mémoire adressable par le processeur central cible et qui renferme un ensemble de programmes d'émulation commençant aux adresses de programmes d'émulation correspondantes. Une séquence d'instructions d'un système source est stockée dans la mémoire adressable par le processeur central d'un système cible, et une logique est prévue pour récupérer une instruction courante d'un système source dans la séquence et pour se brancher directement sur une adresse du programme d'émulation en réponse à l'instruction courante d'un système source. L'unité de stockage de programmes d'émulation est optimisée par sa division sous forme d'une table de répartition comprenant un groupe d'entrées de répartition et une unité de stockage de programmes d'émulation qui conserve en mémoire un groupe d'entrées d'émulation. Chaque entrée de répartition comporte une pluralité d'instructions d'un système cible du programme d'émulation correspondant à une instruction d'un système source spécifique. Les diverses instructions du d'un système cible situées dans une entrée de répartition comprennent une instruction de branchement d'un système cible qui provoque un branchement à une entrée d'émulation. L'entrée d'émulation conserve un programme d'instruction du système cible qui renferme les instructions du système cible permettant de décoder et de pré-extraire les instructions du système cible afin de former une adresse de programme d'émulation destinée à une entrée de répartition pour une instruction suivante du système cible, et de se brancher directement sur l'entrée de répartition.
Designated States: AT, AU, BB, BG, BR, BY, CA, CH, CN, CZ, DE, DK, ES, FI, GB, HU, JP, KP, KR, KZ, LK, LU, LV, MG, MN, MW, NL, NO, NZ, PL, PT, RO, RU, SD, SE, SK, UA, US, UZ, VN.
European Patent Office (AT, BE, CH, DE, DK, ES, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)