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1. (WO1994016507) DELAY LINE SEPARATOR FOR DATA BUS
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/1994/016507    International Application No.:    PCT/US1994/000682
Publication Date: 21.07.1994 International Filing Date: 12.01.1994
Chapter 2 Demand Filed:    11.07.1994    
IPC:
G06F 13/42 (2006.01), H04L 7/02 (2006.01)
Applicants: APPLE COMPUTER, INC. [US/US]; 20525 Mariani Avenue, Cupertino, CA 95014 (US)
Inventors: VAN BRUNT, Roger; (US).
OPRESCU, Florin; (US)
Agent: GROSS, Stephen, D.; Blakely, Sokoloff, Taylor & Zafman, 12400 Wilshire Boulevard, 7th floor, Los Angeles, CA 90025 (US)
Priority Data:
08/004,441 14.01.1993 US
Title (EN) DELAY LINE SEPARATOR FOR DATA BUS
(FR) SEPARATEUR DE LIGNES DE RETARD POUR BUS DE DONNEES
Abstract: front page image
(EN)The delay line separator extracts a clock signal from a combined data/clock encoded signal received over a serial data bus, despite the presence of significant duty cycle distortion. Such distortion affects the width of symbols within received data packets but does not affect the timing between successive rising edges within the received pulse string. To extract the clock signal from the distorted signal, the separator exploits a pre-filter circuit which generates 20-nanosecond pulses synchronized with each rising edge in the received signal. A 20-nanosecond pulse train is transmitted down a delay line having twelve delay elements. Circuits are connected to every other delay element within the delay line for generating 10-nanosecond pulses, synchronized with each rising edge of the pulse train. Outputs from the circuits are combined using an OR gate to yield a 10-nanosecond clock signal. The pre-filter generates 20-nanosecond pulses, rather than 10-nanosecond pulses, to ensure that the pulses successfully propagate the entire length of the delay line, despite the presence of significant dispersion within each delay element. Additional circuits are tapped into the delay elements, as desired, to generate additional clock signals delayed by 5- or 10-nanosecond intervals.
(FR)Le séparateur de lignes de retard extrait un signal d'horloge d'un signal codé d'horloge/de données combiné reçu par l'intermédiaire d'un bus de données série malgré la présence d'une distorsion notable du pourcentage d'utilisation. Ce type de distorsion affecte la largeur des symboles dans les paquets de données reçus mais pas la synchronisation entre les fronts avant successifs dans le train d'impulsions. Pour extraire le signal d'horloge du signal distordu, le séparateur exploite un circuit à préfiltre qui génère des impulsions de 20 nanosecondes synchronisées avec chaque front avant dans le signal reçu. Un train d'impulsions de 20 nanosecondes est transmis, dans une ligne de retard présentant douze éléments à retard. Les circuits sont connectés à un élément à retard sur deux dans la ligne de retard pour générer des impulsions de 10 nanosecondes synchronisées avec chaque front avant du train d'impulsions. Les sorties en provenance des cirucits sont combinées au moyen d'une porte ou de manière à produire un signal d'horloge de 10 nanosecondes. Le préfiltre génère des impulsions de 20 nanosecondes au lieu de 10 nanosecondes afin d'assurer que les impulsions se propagent efficacement sur la longueur totale de la ligne malgré la présence d'une dispersion notable dans chaque élément à retard. Des circuits supplémentaires sont insérés dans les éléments à retard, si besoin est, pour générer des signaux d'horloge supplémentaires retardés par des intervalles de 5 ou 10 nanosecondes.
Designated States: AT, AU, BB, BG, BR, BY, CA, CH, CN, CZ, DE, DK, ES, FI, GB, HU, JP, KP, KR, KZ, LK, LU, LV, MG, MN, MW, NL, NO, NZ, PL, PT, RO, RU, SD, SE, SK, UA, UZ, VN.
European Patent Office (AT, BE, CH, DE, DK, ES, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)