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1. (WO1994016388) SYSTEM AND METHOD FOR CONTROLLING THE INPUT AND OUTPUT OF DATA BETWEEN A HOST PROCESSOR AND AN I/O DEVICE
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/1994/016388    International Application No.:    PCT/US1993/012062
Publication Date: 21.07.1994 International Filing Date: 10.12.1993
Chapter 2 Demand Filed:    11.07.1994    
IPC:
G06F 13/12 (2006.01), G06F 13/40 (2006.01)
Applicants: SEIKO EPSON CORPORATION [JP/JP]; 4-1, Nishishinjuku 2-chome, Shinjuku-ku, Tokyo (JP)
Inventors: LENTZ, Derek; (US).
YAP, Kian-Chin; (US)
Agent: WERNER, Raymond, J.; S-MOS Systems, Inc., 2460 North First Street, San Jose, CA 95131 (US)
Priority Data:
07/997,943 31.12.1992 US
Title (EN) SYSTEM AND METHOD FOR CONTROLLING THE INPUT AND OUTPUT OF DATA BETWEEN A HOST PROCESSOR AND AN I/O DEVICE
(FR) SYSTEME ET PROCEDE PERMETTANT DE COMMANDER L'ENTREE ET LA SORTIE DE DONNEES ENTRE UN PROCESSEUR HOTE ET UN DISPOSITIF D'ENTREE/SORTIE
Abstract: front page image
(EN)An I/O controller (IOU) is provided for transferring data between a host processor and one or more I/O devices. The I/O controller includes means for enabling concurrent performance of two different modes of data transfer between the host processor and the I/O controller. The main memory in the present invention will have its own memory bus while all other I/O devices and memory devices will sit on an external I/O bus. The IOU will interface with a Memory Controller Unit (MCU) to coordinate the data transfer directed to or from the external I/O bus. The I/O Controller also serves as a queuing structure to maximize the memory bandwidth of the memory bus and increase the data flow throughput. The I/O controller serves to provide proper handshaking signals to control the timing and direction of data and address flow.
(FR)Un circuit de commande d'entrées/sorties (IOU) permet de transférer des données entre un processeur hôte et un ou plusieurs dispositifs d'entrée/sortie. Ce circuit de commande comporte un élément qui permet l'utilisation simultanée de deux modes différents de transferts de données entre le processeur hôte et le circuit de commande. Dans cette invention, la mémoire principale est dotée de son propre bus de données alors que tous les autres dispositifs d'entrée/sortie et dispositifs à mémoire se partagent un bus d'entrée/sortie externe. Ce circuit de commande (IOU) s'interface avec un circuit de commande de mémoire (MCU) pour coordonner le transfert de données dirigé vers ou depuis le bus d'entrée/sortie externe. Le circuit de commande (IOU) sert aussi de structure de file d'attente destinée à maximiser la largeur de bande de mémoire du bus de mémoire et à accroître son débit de données. Ce circuit de commande sert en plus à produire les signaux appropriés d'établissement de liaisons pour commander la chronologie et la direction des données et du flux d'adressage.
Designated States: JP.
Publication Language: English (EN)
Filing Language: English (EN)