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1. (WO1994016384) SYSTEM AND METHOD FOR REGISTER RENAMING
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/1994/016384    International Application No.:    PCT/US1993/012308
Publication Date: 21.07.1994 International Filing Date: 16.12.1993
Chapter 2 Demand Filed:    29.07.1994    
IPC:
G06F 9/38 (2006.01)
Applicants: SEIKO EPSON CORPORATION; 4-1, Nishishinjuku 2-chome, Shinjuku-ku, Tokyo (JP)
Inventors: DEOSARAN, Trevor, A.; (US).
GARG, Sanjiv; (US).
IADONATO, Kevin, R.; (US)
Agent: WERNER, Raymond, J.; S-MOS Systems, Inc., 2460 North First Street, San Jose, CA 95131 (US).
GRÜNECKER, A.; Maximilianstrasse 58, D-80538 München (DE)
Priority Data:
07/997,948 31.12.1992 US
Title (EN) SYSTEM AND METHOD FOR REGISTER RENAMING
(FR) SYSTEME ET PROCEDE PERMETTANT DE CHANGER LE NOM D'UN REGISTRE
Abstract: front page image
(EN)A system and method for performing register renaming of source registers in a processor having a variable advance instruction window for storing a group of instructions to be executed by the processor, wherein a new instruction is added to the variable advance instruction window when a location becomes available. A tag is assigned to each instruction in the variable advance instruction window. The tag of each instruction to leave the window is assigned to the next new instruction to be added to it. The results of instructions executed by the processor are stored in a temp buffer according to their corresponding tags to avoid output and anti-dependencies. The temp buffer therefore permits the processor to execute instructions out of order and in parallel. Data dependency checks for input dependencies are performed only for each new instruction added to the variable advance instruction window and register renaming is performed to avoid input dependencies.
(FR)Système et procédé permettant de changer le nom de registres sources dans un processeur présentant une fenêtre d'instructions anticipées variables stockant un groupe d'instructions à exécuter par le processeur, une nouvelle instruction étant ajoutée à ladite fenêtre lorsqu'un emplacement est disponible. Une étiquette est attribuée à chaque instruction dans la fenêtre d'instructions anticipées. L'étiquette de chaque instruction quittant la fenêtre est attribuée à la nouvelle instruction suivante ajoutée à cette dernière. Les résultats des instructions exécutées par le processeur sont stockés dans une mémoire tampon temporaire en fonction de leurs étiquettes correspondantes, afin d'éviter des dépendances de sortie et des anti-dépendances. La mémoire tampon temporaire permet ainsi au processeur d'exécuter les instructions sans ordre et de manière parallèle. Des vérifications de dépendance de données, par rapport à des dépendances d'entrée, sont effectuées uniquement pour chaque nouvelle instruction ajoutée à la fenêtre d'instructions anticipées variables, et le changement de nom du registre est effectué afin d'éviter des dépendances d'entrée.
Designated States: JP, KR.
European Patent Office (AT, BE, CH, DE, DK, ES, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE).
Publication Language: English (EN)
Filing Language: English (EN)