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1. (WO1992001305) MATRIX ADDRESSING ARRANGEMENT FOR A FLAT PANEL DISPLAY WITH FIELD EMISSION CATHODES
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/1992/001305    International Application No.:    PCT/US1991/004823
Publication Date: 23.01.1992 International Filing Date: 12.07.1991
Chapter 2 Demand Filed:    13.02.1992    
IPC:
H01J 3/02 (2006.01), H01J 29/04 (2006.01)
Applicants: COLORAY DISPLAY CORPORATION [US/US]; 1045 Mission Court, Fremont, CA 94539 (US)
Inventors: HOLMBERG, Scott, H.; (US)
Agent: SHERIDAN, James, A.; Flehr, Hohbach, Test, Albritton & Herbert, Four Embarcadero Center, Suite 3400, San Francisco, CA 94111-4187 (US)
Priority Data:
553,428 13.07.1990 US
Title (EN) MATRIX ADDRESSING ARRANGEMENT FOR A FLAT PANEL DISPLAY WITH FIELD EMISSION CATHODES
(FR) SYSTEME D'ADRESSAGE MATRICIEL POUR UN AFFICHAGE A ECRAN PLAT, COMPRENANT DES CATHODES A EMISSION DE CHAMP
Abstract: front page image
(EN)A matrix addressed flat panel display, is disclosed herein and includes a lower planar array of spaced apart, parallel, electrically conductive leads (28) and a matrix array of field emission cathodes (29) connected to and extending up from the lower planar array of electrically conductive leads (28). An upper matrix array of spaced-apart parallel electrically conductive leads (30) is located above and spaced from the lower array of leads (28) and from the cathodes (29), such that the upper leads (30) extend normal to the lower leads (28), crossing the latter immediately above the cathodes (29), and such that those segments of the upper leads (30) that actually cross over the lower leads (28) are positioned in a plane closer to the lower leads (28) than the rest of the upper leads (30). The upper and lower planar arrays of leads (28, 30) are electrically insulated from one another by means of a pair of separately formed layers (32, 34) of dielectric material disposed therebetween.
(FR)L'invention concerne un affichage à écran plat à matrices adressées, comprenant un réseau plan inférieur de fils électroconducteurs (28), parallèles et espacés les uns des autres et un réseau matriciel de cathodes (29) à émission de champ connecté à un réseau plan de fils électroconducteurs (28) et s'étendant depuis ce dernier. Un réseau matriciel supérieur de fils électroconducteurs parallèles et espacés les uns des autres (30) se situe au-dessus du réseau inférieur de fils (28) et se trouve espacé dudit réseau inférieur (28) et des cathodes (29), de sorte que les fils supérieurs (30) s'étendant normalement jusqu'aux fils inférieurs (28), et croisent ces derniers juste au-dessus des cathodes (29), de manière à ce que les segments de fils supérieurs (30) qui passent au-dessus des fils inférieurs (28) soient positionnés dans un plan qui se trouve plus proche des fils inférieurs (28) que du reste desfils supérieurs (30). Les réseaux de fils plans supérieur et inférieur (28, 30) sont isolés électriquement l'un de l'autre par un système de couches (32, 34) formées séparément, d'un matériau diélectrique déposé entre lesdits réseaux.
Designated States: JP, KR.
European Patent Office (AT, BE, CH, DE, DK, ES, FR, GB, GR, IT, LU, NL, SE).
Publication Language: English (EN)
Filing Language: English (EN)