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1. (WO1991009403) DUAL PORT, DUAL SPEED IMAGE MEMORY ACCESS ARRANGEMENT
Latest bibliographic data on file with the International Bureau

Pub. No.: WO/1991/009403 International Application No.: PCT/US1990/007035
Publication Date: 27.06.1991 International Filing Date: 03.12.1990
IPC:
G06F 12/04 (2006.01) ,G06F 12/06 (2006.01) ,G06T 1/60 (2006.01) ,G11C 11/401 (2006.01) ,G11C 7/10 (2006.01) ,H04N 5/907 (2006.01) ,H04N 7/01 (2006.01) ,H04N 7/24 (2011.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
12
Accessing, addressing or allocating within memory systems or architectures
02
Addressing or allocation; Relocation
04
Addressing variable-length words or parts of words
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
12
Accessing, addressing or allocating within memory systems or architectures
02
Addressing or allocation; Relocation
06
Addressing a physical block of locations, e.g. base addressing, module addressing, address space extension, memory dedication
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
T
IMAGE DATA PROCESSING OR GENERATION, IN GENERAL
1
General purpose image data processing
60
Memory management
G PHYSICS
11
INFORMATION STORAGE
C
STATIC STORES
11
Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor
21
using electric elements
34
using semiconductor devices
40
using transistors
401
forming cells needing refreshing or charge regeneration, i.e. dynamic cells
G PHYSICS
11
INFORMATION STORAGE
C
STATIC STORES
7
Arrangements for writing information into, or reading information out from, a digital store
10
Input/output (I/O) data interface arrangements, e.g. I/O data control circuits, I/O data buffers
H ELECTRICITY
04
ELECTRIC COMMUNICATION TECHNIQUE
N
PICTORIAL COMMUNICATION, e.g. TELEVISION
5
Details of television systems
76
Television signal recording
907
using static stores, e.g. storage tubes, semiconductor memories
H ELECTRICITY
04
ELECTRIC COMMUNICATION TECHNIQUE
N
PICTORIAL COMMUNICATION, e.g. TELEVISION
7
Television systems
01
Conversion of standards
H ELECTRICITY
04
ELECTRIC COMMUNICATION TECHNIQUE
N
PICTORIAL COMMUNICATION, e.g. TELEVISION
7
Television systems
24
Systems for the transmission of television signals using pulse code modulation
Applicants:
EASTMAN KODAK COMPANY [US/US]; 343 State Street Rochester, NY 14650, US
Inventors:
SANGER, Kurt, Michael; US
Agent:
SCHAPER, Donald, D.; 343 State Street Rochester, NY 14650-2201, US
Priority Data:
451,39815.12.1989US
Title (EN) DUAL PORT, DUAL SPEED IMAGE MEMORY ACCESS ARRANGEMENT
(FR) DISPOSITIF D'ACCES A LA MEMOIRE D'IMAGES A DEUX VITESSES ET A DOUBLE ACCES
Abstract:
(EN) A dual port, dual speed image memory interface is capable of controllably inputting or outputting medium speed serial data through a medium speed port at the same time that high speed serial imagery data is being supplied to or read from a high speed data rate port. Access to the medium speed port is through a mux/demux unit, which is coupled to receive imagery data at the medium data rate and controllably writes successive data signals, in parallel, into respective ones of a set of plural memory units, and controllably reads out data from the parallel-connected memory units and assembles the accessed data in the form of a serial output digital data stream for transmission to a requesting destination device signals at the medium data rate. Access to the high speed port is through a high data rate shift register, which is coupled to receive high speed imagery data and controllably transfers successive pixel signals, in parallel, to the input stage of each of internal shift registers that are coupled to respective row access ports of the plurality of parallel-connected memory units. The contents of the internal shift registers are transferred into associated rows of memory to store successive lines of imagery data. During high speed read out successive rows of memory data are transferred from the internal shift registers into a respective stage of the high data rate shift register, which is then serially clocked for high speed readout.
(FR) Interface de mémoire d'images à deux vitesses et à double accès capable d'entrer ou de sortir, de manière paramètrable, des données sérielles à moyenne vitesse par un accès à moyenne vitesse, en même temps que des données-images sérielles à vitesse élevée sont transmises à un accès de débit à vitesse élevée ou lues à partir de ce dernier. L'accès à l'entrée à moyenne vitesse se fait par une unité multiplexeur/démultiplexeur, connectée pour recevoir des données-images à débit moyen qui enregistre, de manière paramètrable, des données binaires successives, en parallèle, dans les unités respectives d'un ensemble d'unités de mémoire, et lit, de manière paramètrable, les données issues des unités de mémoire connectées en parallèle et assemble les données obtenues sous forme d'un flux de données numériques sortant sériel pour les transmettre à un dispositif récepteur demandeur à débit moyen. L'accès à l'entrée à vitessse élevée se fait par un registre à décalage à débit élevé, connecté pour recevoir des données-images à vitesse élevée, qui transfère, de manière paramètrable, des signaux de pixels successifs en parallèle, au stade d'entrée de chacun des registres à décalage internes qui sont connectés aux entrées des lignes respectives de la pluralité d'unités de mémoire connectées en parallèle. Le contenu des registres à décalage internes est transféré dans des lignes associées de mémoire afin de stocker des lignes successives de données-images. Pendant la lecture à vitesse élevée, les rangées successives de données en mémoire sont transférées des registres à décalage internes à un étage respectif du registre à décalage à débit élevé qui est ensuite cadencé sériellement pour une lecture à vitesse élevée.
Designated States: JP
European Patent Office (AT, BE, CH, DE, DK, ES, FR, GB, GR, IT, LU, NL, SE)
Publication Language: English (EN)
Filing Language: English (EN)
Also published as:
EP0458926