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1. (WO1987001223) IMAGE PROCESSOR
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/1987/001223    International Application No.:    PCT/JP1986/000424
Publication Date: 26.02.1987 International Filing Date: 19.08.1986
IPC:
G06T 1/00 (2006.01), G09G 5/39 (2006.01)
Applicants: FANUC LTD [JP/JP]; 3580, Shibokusa Aza-Komanba, Oshino-mura, Minamitsuru-gun, Yamanashi 401-05 (JP) (For All Designated States Except US).
KURAKAKE, Mitsuo [JP/JP]; (JP) (For US Only).
OTSUKA, Shoichi [JP/JP]; (JP) (For US Only)
Inventors: KURAKAKE, Mitsuo; (JP).
OTSUKA, Shoichi; (JP)
Agent: TSUJI, Minoru; Tsuji Patent Office, Daiichi Mansui Bldg., 14, Kandaogawacho 3-chome, Chiyoda-ku, Tokyo 101 (JP)
Priority Data:
60/181567 19.08.1985 JP
Title (EN) IMAGE PROCESSOR
(FR) PROCESSEUR D'IMAGES
Abstract: front page image
(EN)A CRT controller (6) having a function to read out a predetermined image from a frame memory (2) that stores images to be processed, causes a window memory (5) to generate bit patterns, the window memory (5) having a size that corresponds to said frame memory (2) and storing bit patterns that designate the validity or invalidity of image operations. Bit patterns are formed in response to the object that is to be processed by the frame memory (2), and the image processing is conducted only on the image data in the region of frame memory (2) specified by the bit patterns.
(FR)Un contrôleur de tubes cathodiques (6) possédant une fonction de lecture d'une image prédéterminée dans une mémoire de trame (2), où sont stockées des images à traiter, amène une mémoire de fenêtre (5) à produire des configurations de bits, la mémoire de fenêtre (5) possédant une taille qui correspond à ladite mémoire de trame (2) et stockant des configurations de bits qui désignent la validité ou l'invalidité des opérations sur les images. Les configurations de bits sont formées en réponse à l'objet devant être traité par la mémoire de trame (2) et le traitement de l'image n'est exécuté que sur les données de l'image dans la région de la mémoire de trame (2) spécifiée par les configurations de bits.
Designated States: KR, US.
European Patent Office (DE, FR, GB).
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)