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1. (WO1985002306) DYNAMIC ECL CIRCUIT ADAPTED TO DRIVE LOADS HAVING SIGNIFICANT CAPACITANCE
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/1985/002306    International Application No.:    PCT/US1984/001712
Publication Date: 23.05.1985 International Filing Date: 22.10.1984
IPC:
H03K 19/013 (2006.01), H03K 19/086 (2006.01)
Applicants: ADVANCED MICRO DEVICES, INC. [US/US]; 901 Thompson Place, P.O. Box 3453, Sunnyvale, CA 94088 (US)
Inventors: VARADARAJAN, Hemmige, D.; (US)
Agent: KING, Patrick, T.; 901 Thompson Place, P.O. Box 3453, Sunnyvale, CA 94088 (US)
Priority Data:
550,528 09.11.1983 US
Title (EN) DYNAMIC ECL CIRCUIT ADAPTED TO DRIVE LOADS HAVING SIGNIFICANT CAPACITANCE
(FR) CIRCUIT ECL DYNAMIQUE CONÇU POUR ENTRAINER DES CHARGES POSSEDANT UNE CAPACITANCE SIGNIFICATIVE
Abstract: front page image
(EN)A dynamic ECL circuit (Figs. 2-5) which drives loads (17, 18) having significant capacitance. The dynamic ECL circuit may utilize single level (Figs. 2-4) or multiple level logic (Fig. 5) and may be configured, for example, as an OR/NOR gate. A capacitor (C1, C2) is placed between the base of a current source transistor (10, 11) and a circuit point having a logic level complementary to the output (30, 31) connected to the current source. As logic transitions occur within the circuit and are presented on the output, a transient current will be experienced through the capacitor due to the shift in the complementary level thereby momentarily alterning the voltage on the base of the current source transistor. The dynamic alteration of base voltage produces a momentary change in the current through the current source transistor which serves to both speed up the high-to-low transition time and the low-to-high transition time on the output line.
(FR)Circuit dynamique de logique à couplage par l'émetteur (ECL); (Figs. 2-5) entraînant des charges (17, 18) possédant une capacitance significative. Le circuit ECL dynamique peut utiliser une logique à niveau simple (Figs. 2-4) ou à niveaux multiples (Figs. 5) et peut être configuré par exemple comme une porte OU/NI. Un condensateur (C1, C2) est placé entre la base d'un transistor de source de courant (10, 11) et un point du circuit ayant un niveau logique complémentaire à la sortie (30, 31) connectée à la source de courant. Au fur et à mesure que des transitions de logique se produisent à l'intérieur du circuit et qu'elles sont présentées sur la sortie, un courant passager sera testé à travers le condensateur en raison du changement du niveau complémentaire modifiant momentanément la tension sur la base du transistor de la source de courant. La modification dynamique de la tension de base produit un changement momentané dans le courant traversant le transistor de la source de courant, ce qui sert à la fois à accélérer le temps de transition élevé à faible et le temps de transition faible à élevé sur la ligne de sortie.
Designated States: JP.
European Patent Office (AT, BE, CH, DE, FR, GB, LU, NL, SE).
Publication Language: English (EN)
Filing Language: English (EN)