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1. (EP0433154) Synchronous-asynchronous converter

Office : European Patent Office
Application Number: 90403512 Application Date: 10.12.1990
Publication Number: 0433154 Publication Date: 19.06.1991
Publication Kind : B1
Designated States: AT, BE, CH, DE, DK, ES, FR, GB, IT, LI, NL, SE
IPC:
H04J 3/16
H04J 3/06
H04L 7/00
H04L 12/64
H04L 12/70
H04Q 3/52
H04Q 11/04
H ELECTRICITY
04
ELECTRIC COMMUNICATION TECHNIQUE
J
MULTIPLEX COMMUNICATION
3
Time-division multiplex systems
16
in which the time allocation to individual channels within a transmission cycle is variable, e.g. to accommodate varying complexity of signals, to vary number of channels transmitted
H ELECTRICITY
04
ELECTRIC COMMUNICATION TECHNIQUE
J
MULTIPLEX COMMUNICATION
3
Time-division multiplex systems
02
Details
06
Synchronising arrangements
H ELECTRICITY
04
ELECTRIC COMMUNICATION TECHNIQUE
L
TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
7
Arrangements for synchronising receiver with transmitter
H ELECTRICITY
04
ELECTRIC COMMUNICATION TECHNIQUE
L
TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
12
Data switching networks
64
Hybrid switching systems
H ELECTRICITY
04
ELECTRIC COMMUNICATION TECHNIQUE
L
TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
12
Data switching networks
70
Packet switching systems
H ELECTRICITY
04
ELECTRIC COMMUNICATION TECHNIQUE
Q
SELECTING
3
Selecting arrangements
42
Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker
52
using static devices in switching stages, e.g. electronic switching arrangements
H ELECTRICITY
04
ELECTRIC COMMUNICATION TECHNIQUE
Q
SELECTING
11
Selecting arrangements for multiplex systems
04
for time-division multiplexing
CPC:
H04L 12/64
H04J 3/0632
H04J 2203/0089
H04L 2012/5672
H04Q 11/0478
Applicants: CIT ALCATEL
Inventors: BALZANO JEAN-MICHEL
LE BOUFFANT ALAIN
Priority Data: 8916497 13.12.1989 FR
Title: (DE) Synchron-Asynchron-Umsetzer
(EN) Synchronous-asynchronous converter
(FR) Convertisseur synchrone-asynchrone
Abstract: front page image
(FR) Le convertisseur comprend une mémoire (SRAM) ayant un premier et un deuxième port, un circuit de gestion du premier port (SPM) relié au premier port, à une ligne multiplex synchrone entrante (ME) et à une ligne multiplex synchrone sortante (MS), et un circuit de gestion du deuxième port (APM) relié au deuxème port, à une liaison asynchrone entrante (LE) par l'intermédiaire d'une mémoire cellules (M) de type FIF0, et à une liaison asychrone sortante (LS). Une commande (MF) extérieure au convertisseur, et appliquée aux circuits de gestion des ports permet de choisir le mode de fonctionnement du convertisseur; dans un premier mode (M32) chaque intervalle temporel d'une trame d'un multiplex synchrone est affecté à un canal de communication et dans un deuxième mode (M1) tous les intervalles temporels d'une trame synchrone sont affectés à un canal.
Also published as:
ES2081958RU02097929JP3084058JPH04504641DE000069024928AU1991069102
FR2655794WO/1991/009480