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1. (WO2002103767) EPITAXIAL SIO¿X? BARRIER/INSULATION LAYER______________________
Aktuellste beim Internationalen Büro vorliegende bibliographische Daten   

Veröff.-Nr.: WO/2002/103767 Internationale Anmeldenummer PCT/US2001/040970
Veröffentlichungsdatum: 27.12.2002 Internationales Anmeldedatum: 14.06.2001
Antrag nach Kapitel 2 eingegangen: 08.01.2003
IPC:
H01L 21/762 (2006.01)
H Elektrotechnik
01
Grundlegende elektrische Bauteile
L
Halbleiterbauelemente; elektrische Festkörperbauelemente, soweit nicht anderweitig vorgesehen
21
Verfahren oder Geräte, besonders ausgebildet für die Herstellung oder Behandlung von Halbleiter- oder Festkörperbauelementen oder Teilen davon
70
Herstellung oder Behandlung von Bauelementanordnungen bestehend aus einer Vielzahl von einzelnen Schaltungselementen oder integrierten Schaltungen, die in oder auf einem gemeinsamen Substrat ausgebildet sind, oder von bestimmten Teilen hiervon; Herstellung von integrierten Schaltungsanordnungen oder von bestimmten Teilen hiervon
71
Herstellung von bestimmten Teilen der in Gruppe H01L21/7075
76
Ausbildung von isolierenden Bereichen zwischen Schaltungselementen
762
Dielektrische Bereiche
Anmelder:
WANG, Chia-Gee [US/US]; US (UsOnly)
TSU, Raphael [US/US]; US (UsOnly)
LOFGREN, John, Clay [US/US]; US (UsOnly)
NANODYNAMICS, INC. [US/US]; 510 E. 73rd Street New York, NY 10021, US (AllExceptUS)
Erfinder:
WANG, Chia-Gee; US
TSU, Raphael; US
LOFGREN, John, Clay; US
Vertreter:
HANDELMAN, Joseph, H. ; Ladas & Parry 26 West 61st Street New York, NY 10023, US
Prioritätsdaten:
Titel (EN) EPITAXIAL SIOX BARRIER/INSULATION LAYER______________________
(FR) COUCHE BARRIERE OU ISOLANTE EPITAXIALE EN SIOX
Zusammenfassung:
(EN) A method for producing an insulating or barrier layer (Fig. 1B), useful for semiconductor devices, comprises depositing a layer of silicon and at least one additional element on a silicon substrate whereby said deposited layer is substantially free of defects such that epitaxial silicon substantially free of defects can be deposited on said deposited layer. Alternatively, a monolayer of one or more elements, preferably comprising oxygen, is absorbed on a silicon substrate. A plurality of insulating layers sandwiched between epitaxial silicon forms a barrier composite. Semiconductor devices are disclosed which comprise said barrier composite.
(FR) L'invention concerne un procédé de production d'une couche barrière ou isolante (fig. 1B), utile pour des dispositifs à semi-conducteurs. Le procédé consiste à déposer une couche de silicium et au moins un élément supplémentaire sur un substrat de silicium, ladite couche déposée étant sensiblement exempte de défauts afin qu'un silicium épitaxial sensiblement exempt de défauts puisse être déposé sur la couche déposée. Dans une autre forme de réalisation, une monocouche d'un ou de plusieurs éléments, de préférence comprenant oxygène, est absorbée sur un substrat de silicium. Plusieurs couches isolantes prises en sandwich entre un silicium épitaxial forment un composite barrière. L'invention concerne en outre des dispositifs à semi-conducteurs comprenant ce composite barrière.
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Designierte Staaten: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, US, UZ, VN, YU, ZA, ZW
African Regional Intellectual Property Organization (ARIPO) (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZW)
Eurasische Patentorganisation (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Europäisches Patentamt (EPO) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG)
Veröffentlichungssprache: Englisch (EN)
Anmeldesprache: Englisch (EN)