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1. (WO2000070620) SPEICHERANORDNUNG MIT ADRESSVERWÜRFELUNG
Aktuellste beim Internationalen Büro vorliegende bibliographische Daten   

TranslationÜbersetzung: Original-->Deutsch
Veröff.-Nr.:    WO/2000/070620    Internationale Anmeldenummer    PCT/EP2000/004285
Veröffentlichungsdatum: 23.11.2000 Internationales Anmeldedatum: 11.05.2000
Antrag nach Kapitel 2 eingegangen:    08.12.2000    
IPC:
G06F 12/14 (2006.01), G06K 19/073 (2006.01), G07F 7/10 (2006.01)
Anmelder: GIESECKE & DEVRIENT GMBH [DE/DE]; Prinzregentenstrasse 159, D-81677 München (DE) (For All Designated States Except US).
BALDISCHWEILER, Michael [DE/DE]; (DE) (For US Only).
ECKARDT, Stefan [DE/DE]; (DE) (For US Only)
Erfinder: BALDISCHWEILER, Michael; (DE).
ECKARDT, Stefan; (DE)
Vertreter: KLUNKER, SCHMITT-NILSON, HIRSCH; Winzererstrasse 106, D-80797 München (DE)
Prioritätsdaten:
199 22 155.3 12.05.1999 DE
Titel (DE) SPEICHERANORDNUNG MIT ADRESSVERWÜRFELUNG
(EN) MEMORY ARRAY WITH ADDRESS SCRAMBLING
(FR) ENSEMBLE MEMOIRE AVEC HACHAGE DES ADRESSES
Zusammenfassung: front page image
(DE)Vorgeschlagen wird eine Speicheranordnung mit einem Speicher mit einer Vielzahl von Speicherzellen (10) sowie einer Auswahleinrichtung (14), die aufgrund einer über einen Adressbus (20) zugeführten logischen Adresse (23) eine Speicherzelle (10) für einen physikalischen Zugriff auswählt. Die Auswahleinrichtung (14) beinhaltet eine Verwürfelungsvorrichtung (15), die einer der Auswahleinrichtung (14) übermittelten logischen Adresse (23) durch Verwürfelung in vorhersehbarer Weise eine Speicherzelle (10) in der Speicheranordnung zuordnet, auf die anschließend der physikalische Zugriff erfolgt.
(EN)The invention relates to a memory array comprising a memory with a plurality of memory cells (10) and a selecting device (14) that selects a memory cell (10) for physical access on the basis of a logical address (23) supplied by means of an address bus (20). The selecting device (14) includes a scrambling device (15) which assigns a memory cell (10) in the memory array to one of the logical addresses (23) transmitted to the selecting device (14) by scrambling in a foreseeable manner, said memory cell then being physically accessed.
(FR)L'invention concerne un ensemble mémoire comportant une mémoire et une pluralité de cellules de mémoire (10), ainsi qu'un dispositif de sélection (14) qui, sur la base d'une adresse (23) logique amenée par l'intermédiaire d'un bus d'adresses (20), sélectionne une cellule de mémoire (10) pour un accès physique. Le dispositif de sélection (14) contient un dispositif de hachage (15) qui associe, par hachage d'une façon prévisible, une cellule de mémoire (10) de l'ensemble mémoire à une adresse (23) logique transmise au dispositif de sélection (14), cellule de mémoire à laquelle se fait ensuite l'accès physique.
Designierte Staaten: AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, CA, CH, CN, CR, CU, CZ, DK, DM, DZ, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, US, UZ, VN, YU, ZA, ZW.
African Regional Intellectual Property Organization (GH, GM, KE, LS, MW, SD, SL, SZ, TZ, UG, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
European Patent Office (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG).
Veröffentlichungssprache: German (DE)
Anmeldesprache: German (DE)