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1. (WO2000076068) SINGLE RAIL DOMINO LOGIC FOR FOUR-PHASE CLOCKING SCHEME
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2000/076068    International Application No.:    PCT/US2000/015533
Publication Date: 14.12.2000 International Filing Date: 05.06.2000
IPC:
H03K 19/096 (2006.01)
Applicants: S3 INCORPORATED [US/US]; 2801 Mission College Boulevard, Santa Clara, CA 95052 (US)
Inventors: ABDEL-HAFEEZ, Saleh; (US).
RANJAN, Nalini; (US)
Agent: CAVANAGH, Daniel, M.; Christie, Parker & Hale, LLP, 350 West Colorado Blvd., Post Office Box 7068, Pasadena, CA 91109-7068 (US)
Priority Data:
09/326,161 04.06.1999 US
Title (EN) SINGLE RAIL DOMINO LOGIC FOR FOUR-PHASE CLOCKING SCHEME
(FR) LOGIQUE EN DOMINO A POLE UNIQUE DESTINEE A UN TYPE DE CADENCEMENT EN QUATRE PHASE
Abstract: front page image
(EN)A single rail domino logic circuit (Figure 1) using a four-phase clocking scheme. A stacked PMOS pair (123, 125) provides a quarter clock cycle precharge time. The quarter clock cycle precharge time allows for placement of an additional inverter in the output signal (19) path to form both an output signal and a complement of the output signal (21) for use in subsequent logic stages.
(FR)L'invention concerne un circuit logique en domino à pôle unique fonctionnant avec un type de cadencement en quatre phase. Deux PMOS superposés produisent un temps de précharge de cycle par quart d'horloge. Ce temps de précharge permet de placer un inverseur supplémentaire dans la voie de signaux de sortie pour constituer un signal de sortie et un complément de signal de sortie destinés à être utilisés dans des étapes logiques subséquentes.
Designated States: CA, JP.
European Patent Office (EPO) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE).
Publication Language: English (EN)
Filing Language: English (EN)